Montevideo, 27-29 de setiembre de 2006

IBERSENSOR 2006

Transductor de Aceleracin para la Deteccin de Sismos Fuertes

J. R. Santalucia1 ; E. Gargiulo2
Instituto de Investigaciones Antissmicas (IDIA) Facultad de Ingeniera Universidad Nacional de San Juan
Av. Libertador San Martn 1290 Oeste (5400) San Juan Rep. Argentina - TE: 54-264-4228123
1
Sub-Director IDIA - email: jrsanta@unsj.edu.ar
2
Investigador IDIA - email: egargiulo@unsj.edu.ar

Resumen: Para poder analizar el efecto ssmico sobre las construcciones, la variable ms utilizada es la aceleracin del terreno provocada por el movimiento de la tierra. Comercialmente se disponen de algunos circuitos
integrados para medir aceleraciones que estn diseados para otras aplicaciones, por lo que no tienen las especificaciones ptimas que se requieren para su aplicacin en sismologa. El presente trabajo describe el desarrollo de un transductor de aceleracin para ser utilizado en acelermetros para la deteccin y registro de sismos
fuertes, utilizando sensores de aceleracin integrados y acondicionamiento de seal mediante arreglos analgicos configurados por software (FPAA).
Palabras Clave: Registro Ssmico - Acelermetro FPAA
Abstract: To be able to analyze the effect of the earthquake on the constructions, the most used variable is the
ground acceleration incited by the earthquake. There are some commercial ICs designed for other applications to measure the acceleration, but they do not have the optimal specifications for seismology. This paper
describes the development of an acceleration transducer to be used in accelerometers for the detection and storage of strong earthquakes, using integrated acceleration sensors and signal conditioning by means of Field Programmable Analog Array (FPAA).
Keywords: Seismic Register - Accelerometer FPAA

1. Introduccin
Para poder analizar el efecto ssmico sobre las construcciones, la variable ms utilizada es la aceleracin
del terreno provocada por el movimiento de la tierra
en sus tres componentes: Vertical, N-S y E-O. Al ser
imposible predecir la ocurrencia de un sismo, y al ser
stos relativamente escasos, los acelermetros analizan la informacin permanentemente pero slo registran la seal ante la presencia de un evento ssmico,
haciendo que el instrumental funcione en forma autnoma durante periodos prolongados de tiempo y
permitiendo un mejor aprovechamiento del sistema
de almacenamiento [1].Para ser posible este registro selectivo es necesario
desarrollar un algoritmo que analice las seales en
tiempo real y detecte la ocurrencia de un sismo, de
acuerdo a determinados parmetros prefijados, para
indicar el comienzo de un registro.Como esta indicacin ocurre con el sismo propiamente dicho se puede perder el inicio del mismo.
Para no perder informacin, la seal registrada debe
ser la ocurrida un tiempo anterior (tiempo de preevento), lo que se logra mediante un retardo electrnico de la seal en forma digital [2].En el Laboratorio de Electrnica del Instituto de
Investigaciones Antissmicas de la Facultad de Ingeniera de la Universidad Nacional de San Juan, Repblica Argentina, se ha desarrollado un acelermetro capaz de registrar en forma selectiva en memoria
digital las tres componentes de la aceleracin del
terreno, el que est subdividido en cuatro estructuras
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fundamentales: transductor de aceleracin, microcontrolador, dispositivo lgico programable complejo (CPLD) y memoria digital (Figura 1).Las seales ssmicas son sensadas y acondicionadas
por el bloque acelermetro, luego son digitalizadas y
analizadas en tiempo real por el micro controlador, y
por ltimo son almacenadas en la memoria para lo
cual se hace el direccionamiento a travs de un
CPLD.Para los transductores de aceleracin se utilizaron
sensores micromaquinados en silicio completamente
integrados, cuyas salidas se conectaron a arreglos
analgicos configurados por software (FPAA).

Figura 1: Acelermetro Diagrama en Bloques

El presente trabajo describe el transductor de aceleracin desarrollado para esta aplicacin especfica.

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Tabla 1 Acelermetros de bajo g

Analog Devices

Acelermetros de bajo g

ST
Mi-

2.1 Sensores de aceleracin

Los circuitos integrados que se disponen comercialmente para medir aceleraciones permiten, mediante
la apropiada conexin de algunos componentes externos, disponer directamente de la seal analgica
de aceleracin a la que est sometido en su eje de
medicin.stos estn diseados para aplicaciones tales como
medida de vibraciones en maquinarias y en distintos
tipos de estructuras, deteccin de movimiento y/o
impacto, industria automotriz, etc. Por tal motivo,
estos circuitos integrados no tienen las especificaciones ptimas que se requieren para su aplicacin en
sismologa, especialmente por su elevado fondo de
escala (aceleracin mxima) que implica una baja
sensibilidad del transductor. Adems, la mayora de
los acelermetros comerciales son con principio de
funcionamiento piezoelctrico que tienen una frecuencia mnima de trabajo mayor que cero, por lo
que no son capaces de medir aceleraciones estticas
(aceleracin de la gravedad) o de muy bajas frecuencias como tienen tpicamente los registros ssmicos
[1].Aproximadamente en el ao 1997 la empresa Analog
Devices [4] lanz al mercado los primeros acelermetros micromaquinados en silicio completamente
integrados, cuyo principio de funcionamiento es un
capacitor diferencial y que permite medir aceleraciones estticas (f mn = 0 Hz). Esta familia de acelermetros (ADXLnn) son unidireccionales y tienen un
fondo de escala que vara entre 5g y 250g, aceleraciones sumamente elevadas en sismologa.Con el acelermetro ms sensible de esta familia
(ADXL05) se desarroll un transductor de aceleracin para utilizarlo en el desarrollo del acelergrafo
digital propuesto en este Proyecto [2]. Para alcanzar
niveles de sensibilidad acorde a las necesidades se
dise un amplificador con ganancia programable
digitalmente, de tal manera que permita ajustar fcilmente la sensibilidad al valor ms apropiado de
acuerdo a los niveles de aceleracin esperados en la
ubicacin del acelergrafo (Figura 2).-

posicin se introduce un nivel permanente en la seal

de salida equivalente a la aceleracin de la gravedad.
Por tal motivo para esta componente es necesario
introducir en el acondicionamiento de seal una etapa de traslacin del nivel de continua entre el sensor
y el amplificador de ganancia programable.Los resultados obtenidos fueron aceptables, y para
mejorar sus especificaciones se analizaron las caractersticas de nuevos sensores de aceleracin integrados (de bajo g) ofrecidos por distintos fabricantes
[3].Analog Devices [4] lanz al mercado en el ao 2003
el ADXL103 cuyo fondo de escala es de 1,7g y
que tiene su versin (ADXL203) bidireccional, es
decir, dos acelermetros en el mismo chip con ejes
de medicin ortogonales.Si bien Analog Devices [4] es la empresa pionera en
la fabricacin de acelermetros micromaquinados,
actualmente hay otras empresas que ofrecen productos similares. En el ao 2004 dos fabricantes lanzaron al mercado acelermetros de bajo g. Ellas son
Freescale [5] con su producto MMA1260D y un
fondo de escala de 1,5g, y STMicroelectronics [6]
con el circuito integrado LIS3L02AS4 que tiene
un fondo de escala de 2g y la gran ventaja de ser un
acelermetro triaxial, es decir que se disponen de las
tres componentes ortogonales necesarias en un registro ssmico. La Tabla 1 resume algunos acelermetros de bajo g disponibles comercialmente [3].-

Freescale

2. Descripcin

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Figura 2: Transductor de aceleracin - Esquema general

Al ser unidireccionales, para medir la componente

vertical de la aceleracin del terreno se presenta un
inconveniente adicional, ya que al colocarlo en esa
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ADXL103

1,7g

uniaxial

ADXL203

1,7g

biaxial

ADXL213

1,2g

biaxial
(PWM)

ADXL330

2,0g

triaxial

MMA1260D

1,5g

uniaxial (z)

MMA2260D

1,5g

uniaxial (x)

MMA6260Q

1,5g

biaxial

MMA7260Q

1,5g / 6g

triaxial

LIS2L02

2g / 6g

biaxial

LIS3L02

2g / 6g

triaxial

Analizadas las especificaciones de las distintas alternativas se seleccion el acelermetro LIS3L02AS4

de STMicroelectronics [6] por disponer directamente
las 3 componentes de aceleracin necesarias (una
vertical y dos horizontales), y porque ofrece una
versin de encapsulado que, con ciertas precauciones, es posible utilizarlos soldndolos manualmente.-

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Adems presenta la ventaja que su fondo de escala se

puede seleccionar, mediante una entrada de control,
en 2g 6g. Esta caracterstica es particularmente til
en el Instituto de Investigaciones Antissmicas para
poder utilizarlo tambin en otras aplicaciones, tales
como la medicin de aceleraciones en estructuras
sujetas a ensayos dinmicos (Seccin 3 Aplicaciones).
2.2 Acondicionamiento de seal
Para esta aplicacin, las especificaciones de diseo
proponan disponer de las seales entregadas por los
sensores de aceleracin para cada componente del
registro ssmico con cuatro factores de ganancia
distintos, para poder seleccionar la sensibilidad ms
apropiada del transductor de acuerdo a los niveles de
aceleracin esperados en la ubicacin del acelergrafo.Para el acondicionamiento de seal se utilizaron
modernos dispositivos como son los arreglos analgicos configurados por software (FPAA). Estos circuitos pueden ser configurados para implementar una
variedad de funciones analgicas, y constan de un
arreglo de Bloques Analgicos Configurables (CAB)
inmersos en una red de interconexiones programables que permiten interconectar distintos bloques
entre s o a los bloques de entrada/salida (I/O) [7].Los dispositivos digitales programables revolucionaron el diseo de circuitos digitales durante la dcada
de los 90, pero slo estaban reservados al mundo de
las tcnicas digitales.Si bien algunas compaas haban desarrollado y
anunciado sus productos previamente, en el ao 2000
Lattice Semiconductor [8] revolucion el diseo de
circuitos analgicos introduciendo en el mercado los
primeros dispositivos analgicos programables en el
mismo chip: la familia ispPAC. Esta familia consta
de 4 miembros que contienen componentes analgicos en cada circuito integrado (amplificador de instrumentacin, amplificador-sumador, etc.) los que,
conectndolos adecuadamente mediante programacin, permite ajustar sus parmetros de funcionamiento (ganancia y ancho de banda). El ambiente
grfico de diseo (PAC Designer) es sumamente
sencillo, y permite un rpido desarrollo del prototipo
usando libreras y macros generadores de circuitos.Posteriormente, la empresa Anadigm [9] present
tambin su serie de dispositivos analgicos programables (la familia ANxxxE04) siendo en la actualidad las dos empresas que lideran la provisin de este
tipo de componentes.Los FPAA de Anadigm [9] son dispositivos adecuados para disear e implementar diferentes circuitos
analgicos. Disponen circuitos macros (denominados
CAM) con funciones preestablecidas tales como
amplificacin, suma, integracin, diferenciacin,
comparacin, filtros, osciladores, etc. Usan la tcnica
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de diseo de capacitor conmutado (switchedcapacitor) que provocan un cierto nivel de ruido en

sus seales de salida, por lo que las celdas de I/O
permiten la implementacin de filtros anti-aliasing
para minimizar sus efectos.Por este motivo tambin es conveniente limitar el
ancho de banda de la seal de entrada, que en nuestra
aplicacin es imprescindible por las muy bajas frecuencias que posee tpicamente una seal ssmica.El primer prototipo diseado para nuestro transductor se realiz con el ispPAC10 de Lattice Semiconductor [8] (Figura 3) con el cual, en un solo circuito
integrado, se construy un amplificador con el que se
disponan simultneamente cuatro factores de ganancia distintos de la seal de entrada (Figura 4) para
seleccionar externamente el factor de amplificacin
ms adecuado.-

Figura 3: ispPac10 Estructura interna

El principal inconveniente que se present es que

con este dispositivo no es posible lograr filtros pasabajo con una frecuencia de corte (-3db) de 50 Hz,
valor tpico para esta aplicacin.-

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mienta de diseo Anadigm Filter que genera el circuito y la configuracin necesaria de los CAMs para
disear el filtro acorde a los parmetros deseados.La configuracin seleccionada para esta aplicacin
fue un filtro Butterworth de 2 polos con una frecuencia de corte (-3 db) de 50 Hz (Figura 6).

Figura 4: ispPac10 Respuesta en Frecuencia

Este filtro de 50 Hz s es posible implementarlo con

los FPAA de Anadigm [9] , para lo cual se seleccion el dispositivo AN221E04 con 4 macroceldas
analgicas en su interior que permiten generar cualquier funcin analgica en forma independiente o
entrelazando las macroceldas entre s, 4 celdas configurables de entrada salida, y 2 celdas dedicadas a
salidas (Figura 5).-

Fig.6: Anadigm Filter

Para la etapa amplificadora se utiliz un CAM disponible en los circuitos modulares del software, que
consiste en una etapa amplificadora con ganancia
controlada por tensin (Figura 7).-

Figura 5: AN221E04 - Estructura interna

Los FPAA de Anadigm son los ms flexibles entre

los circuitos analgicos programables disponibles
comercialmente debido al nmero de Bloques Analgicos Configurables (CAB) disponibles en el chip,
la cantidad de funciones analgicas disponibles mediante los Mdulos Analgicos Configurables
(CAM), y adems porque no requiere el uso de componentes externos [7] [9].Si bien la programacin del chip es almacenada en
memoria SRAM interna, y por lo tanto voltil, se
puede generar un archivo para programar una memoria EEPROM de tal manera que el circuito diseado
sea bajado al arreglo analgico desde esta memoria.La configuracin del circuito mediante su ambiente
grfico de diseo (Anadigm Designer 2) es muy
intuitiva y sencilla. Este software incluye la herraISBN: 9974-0-0337-7

Fig.7: Anadigm Designer 2 Circuito amplificador

La ganancia del amplificador deseada para una

tensin de control determinada es especificada
mediante una funcin (lookup table) con 256 valores
posibles.En nuestro diseo se especificaron 4 niveles de ganancia entre 0 db y 20 db. La figura 8 muestra los
resultados de la simulacin para una ganancia 2 (6
db).-

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Fig.8: Anadigm Designer 2 Simulacin

De esta manera, a diferencia del diseo realizado con

el ispPAC10 de Lattice Semiconductor [8], el factor
de ganancia de la nica salida amplificada se selecciona externamente mediante una tensin de control.-

3. Aplicaciones

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Fig.9: Estructura bajo ensayo dinmico

Ensayo Dinmico - Componente Lomgitudinal
100
80
60

Aceleracin [%g]

40
20
0
0

-20
-40
-60
-80
-100

Tiempo [seg]

Ensayo Dinmico - Componente Transversal

80

60

40

Aceleracin [%g]

El transductor descrito forma parte del desarrollo de

un acelergrafo para la deteccin y registro de sismos fuertes que an se encuentra en su faz experimental.Sin embargo, su diseo se ha flexibilizado para ser
utilizado en otras aplicaciones que requieren la medicin de aceleraciones en distintas actividades que
se desarrollan en el Instituto de Investigaciones Antissmicas de la Facultad de Ingeniera de la Universidad Nacional de San Juan, Argentina [10].En el Laboratorio de Estructuras de dicho Instituto
existe una mesa vibratoria con dos grados de libertad
(componente longitudinal y vertical) para realizar
ensayos dinmicos sobre estructuras, ya sea para
calificacin ssmica sobre componentes a escala real
o proyectos de investigacin.El transductor desarrollado ha sido utilizado con
xito en un ensayo dinmico sobre un modelo de
estructura de 2 plantas diseado para estudiar el
comportamiento de disipadores de energa por friccin (EDR) bajo una accin ssmica, Figura 9, instrumentado con tres sensores de posicin (LVDT) y
11 acelermetros. Las seales obtenidas con el acelermetro descrito en el presente trabajo se pueden
observar en la figura 10.

20

0
0

-20

-40

-60

-80

Tiempo [seg]

Fig.10: Aceleraciones registradas

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4. Conclusiones

5. Referencias

En el presente trabajo se ha presentado el desarrollo

de un transductor de aceleracin utilizando tecnologa de ltima generacin.El sensor utilizado permite disponer de las tres componentes de aceleracin necesarias en un registro
ssmico, y para el acondicionamiento de seal se
utilizaron Arreglos Analgicos Programables por
Campo (FPAA) con los que se disearon amplificadores de ganancia y ancho de banda programables
sin requerir componentes externos.Dado que estos dispositivos permiten reconfigurar
dinmicamente su estructura analgica o modificar
sus parmetros de funcionamiento, hacen que el amplificador diseado sea sumamente flexible para
adecuar sus caractersticas a las necesidades de aplicacin especfica.Los resultados experimentales han sido satisfactorios, y como trabajo futuro se pretende optimizar el
diseo de la configuracin de los FPAA para poder
acondicionar dos seales en el mismo circuito integrado, y disear el circuito necesario para que la
configuracin deseada sea cargada mediante una
memoria EEPROM al energizar el circuito.-

[1] F. Scherbaum; Basic Concepts in Digital Signal

Processing for Seismologist, Springer-Verlag, 1994,
01-28.[2] J. Santaluca, E. Gargiulo; Acelermetro Digital
IDIA 2005, Pilar Ediciones, Dic 2005.[3] J. Israelsohn; Newtons chip: Low-g Accelerometers
ICs, EDN - Oct 2004, 65-76.[4] http://www.analog.com/
[5] http://www.freescale.com/
[6] http://eu.st.com/stonline/index.htm
[7] R. Caicedo Grueso, J. Velasco Medina; Diseo de
Circuitos Analgicos usando FPAAs, Universidad
del Valle, Cali, Colombia, 2003.[8] http://www.latticesemi.com/
[9] http://www.anadigm.com/
[10]http://www.fi.unsj.edu.ar/institutos/idia/

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