Session 2 - MSP430 Architecture

Universidad Panamericana
Arquitectura del MSP430
M.C. Fernando Hermosillo Reynoso

fhermosillo@up.edu.mx
Sesión #2
22 de Enero del 2024
Universidad Panamericana Procesamiento de Señales 21 de Enero del 2020

Arquitectura del
Microcontrolador
MSP430
Universidad Panamericana Procesamiento de Señales 21 de Enero del 2020

El Microcontrolador MSP430G2553
MSP: Mixed Signal

Processor
Texas Instruments
Procesador de baja potencia
Bajo costo
Arquitectura: 16 bits
Memoria Flash: 16 Kbytes
Memoria RAM: 512 Bytes
Amplia gama de periféricos
Velocidad de hasta 16MHz
Familia MSP430
Arquitectura
Arquitectura General
Arquitectura tipo Von

Neuman
Arquitectura General: La Memoria de Programa
Almacena las instrucciones

del programa a ejecutar
Típicamente de solo lectura
Arquitectura General: La Memoria de Datos
Almacena datos temporales

usados por el programa
Lectura/Escritura
Es la memoria RAM del
CPU
Arquitectura General: Unidad de Procesamiento Central (CPU)
Captura y ejecuta
instrucciones
Contiene registros de
propósito general, así como
del estado del sistema
Contiene una ALU para la

ejecución de instrucciones
lógicas y aritméticas
Arquitectura General: Unidad de Control
Determina las señales de

control necesarias para leer
la instrucción (fetch),
decodificarla y ejecutarla.
Arquitectura General: Registros
Registros dedicados: Como

parte de la operación de la
computadora
Propósito general: Usados

por el programa para la
ejecución de instrucciones
Arquitectura General: Contador de Programa (PC)
Program Counter:
Almacena la dirección de la
próxima instrucción a
ejecutar
Arquitectura General: Apuntador del Stack (SP)
Stack Pointer: Provee de

forma de alocar el espacio
de variables empleadas en
el programa dentro de la
memoria de datos
3
Arquitectura General: Apuntador del Stack (SP)
Stack Pointer: Provee de

forma de alocar el espacio
de variables empleadas en
el programa dentro de la
memoria de datos
Dirección de retorno al
ingresar a una función
Almacena el valor de retorno
Paso de parámetros
Variables locales
Arquitectura General: Registro de Estado (SR)
Status Register: Provee de

una señalización para los
resultados derivados de alu
Zero
Overflow
Acarreo
Incorpora configuraciones
para operar el MCU en
modo bajo consumo y
habilitar interrupciones
Arquitectura General: Registro de Estado (SR)
Arquitectura General: Generador de Constante (CG)
Constant Generator: Provee

generación automática de
valores más usados,
reduciendo la cantidad de
instrucciones un 30%.
0x0000
0x0001
0x0002
0x0004
0x0008
0xFFFF
Arquitectura General: Registros de Propósito General (GPR)
Registro de Propósito General

Usados para instrucciones
aritméticas, movimiento, …
Arquitectura General: Puertos de Entrada/Salida (GPIO)
Puerto: Terminales físicas

que permiten interactuar
con el mundo externo
Entrada/salida: Diseñados
para transferir información
del MCU al exterior o
viceversa de forma serial o
paralela
Se comunican con el CPU
por medio de una dirección
única
El Banco de Registros del CPU
CPU consta de 16 registros

de 20 bits cada uno
Nombrados como R0, …,R15
Cuatro son registros de

propósito específico
R0: Program counter
R1: Stack pointer
R2: Status register
R3: Constant generator
Los Periféricos
Voltaje de Operación: Dos temporizadores

1.8-3.6V 16 bits con tres registros de
captura/comparación
Reloj de Operación
Hasta 16MHz 24 terminales de entrada /
salida de propósito general
Convertidor Analógico-
Digital (ADC) Interfaz comunicación seri
10 bits, 8 canales UART, SPI, I2C
Comparador Analógico 16 Kbytes ROM
8 canales 512 Kbytes RAM
Los Periféricos
Periféricos controlados
mediante Registros de
Función Especial (SFR)
Registros de Control
Registros de Estado
Registros de Datos
50% de la programación de
un MCU es relacionado a la
operación de los SFR!
Ejemplo de SFR del Timer_A: Registro de Control (TACTL)
Por ejemplo, si se requiere

establecer SMCLK como la
fuente de reloj, basta con
acceder a dicho registro
TACTL |= 0x0200
El Conjunto de Instrucciones
El MSP430 contiene 51
instrucciones
27 son instrucciones de core
(Código de operación único)
24 son emuladas (no tienen
un código de operación)
Clasificación
Movimiento de datos
Manipulación de datos
Control del flujo
El Conjunto de Instrucciones: Transferencia de Datos
El Conjunto de Instrucciones: Manipulación de Datos
Nótese que no existe una instrucción de multiplicación/división!

El Conjunto de Instrucciones: Flujo de Programa
Acceso a la Memoria
El acceso a la memoria
pude ser
Acceso a byte (8 bits)
Acceso a palabra (16 bits)
Ejemplo Ensamblador
Instrucción CALL & RET: Llamadas a funciones
Programa Principal Subrutina: Delay

Address Instrucción Address Instrucción
0x2000 MOV #0x0001, R5 1) PC=0x2003 0x2070
0x2001 XOR R5, P1OUT 2) PUSH(PC) 0x2071
3) PC=0x2070
0x2002 CALL 0x2070 0x2072
0x2003 1) PC=POP() 0x2073 RET
0x2004
0x2005 void main(void) {
STACK
⋮
while(1) { ⋮
0xF000 CALL 0x2070 P1OUT ^= 0x01; Variable 3
0xF002 delay(1000);
Variable 2
0xF003 HLT }
} Variable 1
0x2003
Organización de la Memoria
Establece un mapa de Higher address

direcciones de memoria de
cada elemento que
conforma el MSP430
SFR
GPR
RAM
ROM
Lower address
Organización de la Memoria
Establece un mapa de
direcciones de memoria de
cada elemento que
conforma el MSP430
SFR
GPR
RAM
ROM
El Empaquetado PDIP (Doble Hilera)
El Empaquetado del MSP430
La Tarjeta de Desarrollo
MSP430 LaunchPad
La Tarjeta LauchPad
La tarjeta contiene
MSP430G2553
2 LEDs
1 Botón usuario
1 Botón de Reset
Headers para comunicar el MCU
y sus periféricos con el exterior
Comunicación con PC mediante
USB

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Almacena datos temporales

Contiene una ALU para la

Determina las señales de

Registros dedicados: Como

Propósito general: Usados

Stack Pointer: Provee de

Stack Pointer: Provee de

Status Register: Provee de

Constant Generator: Provee

Registro de Propósito General

Puerto: Terminales físicas

CPU consta de 16 registros

Cuatro son registros de

Voltaje de Operación: Dos temporizadores

Por ejemplo, si se requiere

Nótese que no existe una instrucción de multiplicación/división!

Programa Principal Subrutina: Delay

Establece un mapa de Higher address

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