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DATOS Y RESULTADOS
1. Diseñar solo con compuertas NAND un circuito secuencial asíncrono de dos entradas (C y T) y
dos salidas S1 y S2, donde la salida S2 siempre es el complemento de la salida S1. El circuito
funciona de la siguiente manera. Si C cambia de 0 a 1 cuando T=1, entonces las salidas (S1 y S2)
invierten el valor de su salida actual respectivamente. En otros casos las salidas deben mantener
sus salidas actuales. (Note que el circuito funciona como un Flip Flop tipo T, donde C es la entrada
del clock de flanco positivo). El diseño debe mostrar. Diagrama de Transición, Tabla de Flujo
Primitiva, Tabla de Flujo Reducida, Asignación de Estados, Mapas de Karnaugh y Circuito Lógico.
C
T 00 01 11 10
y
A A/01 B/01 -/-- H/01
0
LABORATORIO DE SISTEMAS DIGITALES EXPERIENCIA N°8
C
T 00 01 11 10
C
T 00 01 11 10
C
T 00 01 11 10
1
LABORATORIO DE SISTEMAS DIGITALES EXPERIENCIA N°8
MAPAS DE KARNAUGH
C
T 00 01 11 10
𝒀𝟏 = 𝒚𝟏. 𝑪’ + 𝒚𝟐. 𝑪 + 𝒚𝟏. 𝒚𝟐
y1 y2
00 𝒀𝟏 = 𝒚𝟏. 𝑪’. 𝒚𝟐. 𝑪. 𝒚𝟏. 𝒚𝟐 PARA EVITAR RIESGOS
ESTÁTICOS
01 1 x
11 1 1 1 1
1
10 1 x
C
T 00 01 11 10
𝒀𝟐 = 𝒚𝟏′ . 𝑪’. 𝑻 + 𝒚𝟐. 𝑪 + 𝒚𝟏. 𝑻′
y1 y2
00 1 𝒀𝟐 = 𝒚𝟏′ . 𝑪’. 𝑻. 𝒚𝟐. 𝑪. 𝒚𝟏. 𝑻′
01 1 1 x
11 1 1 1
x
10 1
C
T 00 01 11 10
𝑸 = 𝒚𝟏. 𝑪’ + 𝒚𝟐. 𝑪 + 𝒚𝟏. 𝒚𝟐 = 𝒀𝟏
y1 y2
𝑸 = 𝒀𝟏
00
01 1 x
11 1 1 1 1
1
10 1 x
2
LABORATORIO DE SISTEMAS DIGITALES EXPERIENCIA N°8
𝑄’ = 𝑦1’. 𝐶’ + 𝑦2’. 𝐶 C
+ 𝒚𝟏′. 𝒚𝟐′ T 00 01 11 10
y1 y2
𝑄’ = 𝑦1’. 𝐶’. 𝑦2’. 𝐶. 𝒚𝟏′. 𝒚𝟐′ 1
00 1 1 1
01 1 1 x
11
x
10 1
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LABORATORIO DE SISTEMAS DIGITALES EXPERIENCIA N°8
LED INDICADOR
DEL CLOCK
(CIRCUITO
ANTIRREBOTE)
Circuito antirrebote
3. En la entrada T y salidas S1 y S2 coloque Leds como indicadores del nivel, tenga la misma
precaución que en ítem anterior.
En la figura 1.4 se puso 2 leds para indicar las salidas S1 y S2 tal como nos muestras las flechas.
S1 S2
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LABORATORIO DE SISTEMAS DIGITALES EXPERIENCIA N°8
A) T=1 CAMBIO EN C DE 0 A 1
En la figura 1.5 se muestra la simulación cuando T=1, donde en un estado inicial Q=1 y Q’=0 y
después de pasar el C de 0 a 1, se obtiene las salidas Q=0 y Q’=1.
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LABORATORIO DE SISTEMAS DIGITALES EXPERIENCIA N°8
En la figura 1.6 se comprobó la simulación de la figura 1.5, cuando T=1, donde en un estado
inicial S1=0 y S2=1 y cambiar el estado C de 0 a 1 con nuestro circuito antirrebote, van a
conmutar las salidas, resultando S1=1 y S2=0.
S1 S2
S1 S2
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B) T=1 CAMBIO EN C DE 0 A 1
En la figura 1.7 se muestra la simulación cuando T=1, donde en un estado inicial Q=0 y Q’=1 y
después de pasar el C de 0 a 1, se obtiene las salidas Q=1 y Q’=0.
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LABORATORIO DE SISTEMAS DIGITALES EXPERIENCIA N°8
En la figura 1.8 se comprobó la simulación de la figura 1.7, cuando T=1, donde en un estado
inicial S1=1 y S2=0 y cambiar el estado C de 0 a 1 con nuestro circuito antirrebote, van a
conmutar las salidas, resultando S1=0 y S2=1.
S1 S2
S1 S2
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LABORATORIO DE SISTEMAS DIGITALES EXPERIENCIA N°8
C) T=0 CAMBIO EN C DE 0 A 1
En la figura 1.9 se muestra la simulación cuando T=0, donde en un estado inicial Q=1 y Q’=0 y
después de pasar el C de 0 a 1, se obtiene las salidas Q=1 y Q’=0 (estado memoria).
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LABORATORIO DE SISTEMAS DIGITALES EXPERIENCIA N°8
En la figura 1.10 se comprobó la simulación de la figura 1.9, cuando T=0, donde en un estado
inicial S1=1 y S2=0 y cambiar el estado C de 0 a 1 con nuestro circuito antirrebote, van a
mantenerse las salidas, resultando S1=1 y S2=0.
S1 S2
S1 S2
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FIGURA 5.1.
En la figura 5.1. Se muestra T=1, mientras que en la entrada C colocamos una señal del
generador.
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FGURA5.2.
FIGURA 5.3
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FIGURA 5.4
FIGURA 5.6.
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En la figura 5.6. y 5.7 . la señal de color amarilla es la señal del CLOCK , mientras que la señal de
color azul muestra la salida Q y la señal de color rosado la salida Q negada.
FIGURA 5.7.
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OBSERVACIONES Y CONCLUSIONES
1. Al implementar el circuito se presentaron dificultades señaladas en los
puntos 2 y 3, lo cual impidió el correcto funcionamiento del circuito diseñado
2. Los cables utilizados en la implementación del circuito hacían falso contacto
con el protoboard generando una falsa lectura.
3. Se debió considerar el voltaje utilizado para energizar el circuito, debido a
que el umbral de voltaje en TTL y CMOS difiere; debido a ello se generó
algunas falsas lecturas
4. Se volvió a implementar el circuito diseñado (fuera del horario de clase)
teniendo en cuenta los puntos anteriores (2,3) y así se consiguió el correcto
funcionamiento del circuito secuencial asíncrono
5. En la experiencia se aprendió que se puede implementar un FLIP FLOP tipo
T flanco positivo haciendo uso de compuertas lógicas NAND mediate la
síntesis de un circuito secuencial asíncrono, haciendo uso de máquinas de
estados finitos, tabla de flujo primitiva, reducción de estados, tabla de flujo
reducida, asignación de estados libre de competencias, tablas Karnaught
para determinar las entradas y salidas.
6. Se observó que debido al retardo propio que presentan las compuertas
presenta distorsión comparado con la que se obtendría si se hiciera uso de
un integrado FF JK (configurado como FF T).
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REFERENCIAS
Thomas L. Floyd-Fundamentos de sistemas digitales
Ronald J.Tocci-Sistemas digitales
John F. Wakerly- Diseño digital
efectoled.com/blog/importancia-del-driver-iluminacion-led
academia.edu/5135557/ANALISIS_Y_SINTESIS_DE_CIRCUIT
OS_SECUENCIALES_ASINCRONOS
youtube.com/watch?v=08AAHvLRzGk
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