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Arquitectura de Computadoras
Arquitectura de Computadoras
F1 F2 F3 F14
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0 0 1 1
0 1 0 0
0 1 0 1
0 1 1 0
Sumador de dos Bits
F2:
F4
D
F3: Reducida
D
Mapas “K”
F1
CD
AB 00 01 11 10
00
01
F1: 0
11 X X X X
10 X X
F2
CD
AB 00 01 11 10
00
01 1
F2: ac+abd+bcd
10 1 1
0 1 1 1
1 1 1 1 1 1 1 1
1 1 1 0 b c d
1 0 1 1
1 0 1 1
a c
F3
CD
AB 00 01 11 10
00 1 1
01 1 1
F3: ac´d´+ab´c´+a´bc´d+abcd+a´b´c´+a´cd
10 1 1
0 1 1 1
0 0 1 1
a´ c d
F4
CD
AB 00 01 11 10
00
1 1
01 1 1
F4: bd´+b´d
11 1 1
10 1 1
0 1 0 0 0 0 0 1
0 1 1 0 0 0 1 1
1 1 0 0 1 0 0 1
1 1 1 0 1 0 1 1
b d´ b´ d
A B C D
UNIVERSIDAD DEL VALLE DE MEXICO
CAMPUS SUR SEDE TLALPAN
“ARQUITECTURA DE COMPUTADORAS”
SUMADOR DE 2 BITS
INTEGRANTES