31/03/2013

FACULTAD DE INGENIERIA
Escuela Acadmica Profesional: Ingeniera de Sistemas
CURSO

PLATAFORMAS TECNOLGICAS

Arquitectura del computador

Anlisis de la arquitectura CISC

Ing. IVAN MARTIN PEREZ FARFAN

Plataformas Tecnolgicas

Qu es
RISC?

Qu es
CISC?,

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Plataformas Tecnolgicas

MICROPROCESADOR
Se clasifican segn:

Arquitectura:

Hardware

La arquitectura de un
procesador consiste en el
conjunto de caractersticas
que lo identifican.
Describe
de
manera
resumida las capacidades y
posibilidades de operacin
del microprocesador.

CISC

Software
Von
Neuman

Segmentada

Arquitectura

RISC
Hardvare

CRISC

Plataformas Tecnolgicas

Evolucin de la Estructura Bsica de los computadores

Los primeros
principios:

computadores se construyeron siguiendo dos

Diagrama por bloques del procesador central

a)

El modelo de VON
NEUMANN, que inclua
el
concepto
de
PROGRAMA
ALMACENADO y el de
la RUPTURA DE LA
SECUENCIA en
el
programa.

CPU
INSTRUCCIONES

UNIDAD DE
CONTROL

INSTRUCIONES

DATOS

b)

La
tecnologa
electrnica de la poca,
que hacia uso de las
VALVULAS DE VACIO.

MEMORIA
PRINCIPAL

INSTRUCCION
ES Y

DATOS

A.L.U.

E/S

PRIMERA ETAPA

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Evolucin de la Estructura Bsica de los computadores

La unidad de control extrae la instruccin de la memoria principal, la interpreta
y efecta las siguientes operaciones:
a)
b)
c)
d)

Establece
el
conexionado
elctrico de la ALU
Extrae los datos de la
MEMORIA
Ordena la ejecucin a la ALU
Almacena el resultado en la
MEMORIA

Diagrama por bloques del procesador central

CPU
INSTRUCCIONES

UNIDAD DE
CONTROL

MEMORIA
PRINCIPA
L

La ALU es el bloque operativo que

INSTRUCCIO
DATOS
desarrolla todas las posibles
NES Y
A.L.U.
funciones aritmticos lgicos.
DATOS
Tanto la LOGICA DE CONTROL
como
la
MEMORIA,
estn
construidas con VALVULAS DE
PRIMERA
E/S
VACIO con que la velocidad de
ETAPA
funcionamiento de ambos era
similar.
La sencillez de la CPU y la escasez de registros internos de trabajo imponan una
constante transferencia con la MEMORIA empleando un conjunto reducido y bsico de
instrucciones de mquina.

Plataformas Tecnolgicas

Evolucin de la Estructura Bsica de los computadores

SEGUNDA ETAPA
La 2 generacin se caracteriza por el uso de
transistores discretos, diodos y memorias de
ncleos de ferrita interconectados por circuitos
impresos, en esta etapa se produce un
distanciamiento entre la tecnologa usada en la
construccin de la Unidad de Control y en la
memoria principal.
La velocidad de la memoria principal es mucho
menor que la de la CPU (unas 10 veces), lo que
provoca largos perodos de inactividad en la
CPU, mientras se acceda a memoria.
En muchos computadores la CPU pas a contener a
la Memoria de Control, que se trataba de una
rapidsima memoria en la que se almacenaban las
operaciones elementales correspondientes a cada
instruccin compleja, llamndose microinstruccin
a cada una de las posiciones de esta Memoria de
Control.

Surgieron juegos de instrucciones complejos, en los que

cada instruccin equivala a varias operaciones simples,
llamadas operaciones elementales, as se evitaban muchos
accesos a la memoria principal, al mismo tiempo que se
sacaba el mximo rendimiento de la rpida CPU.
A este tipo de computadores se les denomina CISC
(Computadores de Juego de Instrucciones Complejo).

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Evolucin de la Estructura Bsica de los computadores

TERCERA ETAPA
La 3 generacin se caracteriza por el empleo de
circuitos integrados (IC) para la unidad
aritmtico-lgica (ALU) y memorias, se comienza
con SSI (Small Scale Integration) para concluir con
MSI (Mdium Scale Integration).
Las computadoras nuevamente se hicieron ms
pequeas, ms rpidas, desprendan menos calor y
eran energticamente ms eficientes.
Aparece la memoria cache ultrarrpida, del tipo
tampn, que se encarga de guardar la
informacin de uso ms frecuente de la memoria
principal, para disminuir el nmero de accesos a
esta ltima. Estas memorias equilibran la
diferencia de velocidades entre la CPU y la
memoria principal.
Como se observa en la figura, la Unidad de Control
se alimenta desde la memoria cache, o bien, cuando
la informacin que necesita no est en ella,
directamente desde la memoria principal.

El contenido que guarda la cache est optimizado para que

sea el de ms uso, consiguiendo velocidades de 5 a 10
veces mayores que la memoria principal.

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Evolucin de la Estructura Bsica de los computadores

CUARTA ETAPA
La 4 generacin se caracteriza por el empleo de
LSI y VLSI(Very Large Scale Integration) y
memorias de semiconductores de alta velocidad.
Con el fin de mejorar la velocidad de la UCP y
equilibrarla con la de la memoria cache, se han
adoptado los siguientes criterios en el diseo de la
arquitectura de los computadores:
1.Eliminacin de la microcodificacin.
Todas las
instrucciones seran del tipo elemental, no existiendo
instrucciones complejas.
2.Reduccin del tiempo del ciclo mquina, como
consecuencia de la simplificacin de las instrucciones.
3.Interpretacin directa de las instrucciones por el
hardware y ejecucin de cada una de ellas en un solo
ciclo mquina.
4.Seleccin del mnimo nmero de instrucciones
simples.

Con este nuevo enfoque surgieron los computadores RISC, Computadores de Conjuntos
de Instrucciones Reducidos cuya arquitectura bsica responda al diagrama inicial,
aunque con la inclusin de una memoria cache.

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Arquitectura
Software

Complex Instruction Set Computer

CISC

Set de instrucciones complejas

RISC

Reduced Instruction Set Computer

Set de instrucciones reducidas

CRISC

Combinacin de CISC con RISC

Complex-Reduced Instruction Set Computer

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Arquitectura CISC
La arquitectura CISC (Complex Instruction Set Computer,
computador de conjunto complejo de instrucciones)
CISC refleja la forma en que se desarrollaban y
las mejoras que se haban introducido a las
arquitecturas de procesadores hasta, ms o
menos, 1975. CISC, el Computador con un
Conjunto Complejo de Instrucciones (Complex
Instruction Set Computer), representa el nombre
la corriente principal desarrollada en
arquitectura de computadores y, quizs,
podramos entender que es el nombre que se
dio a la tendencia a la cual el movimiento
RISC se opona.

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Arquitectura CISC

Complex Instruction Set Computer

Set de instrucciones grande
Ofrece una amplia gama de
operaciones
Facilita el trabajo de programacin
Reduce el tamao del cdigo de
programa
Incrementa el costo de aprender la
programacin

Plataformas Tecnolgicas

Arquitectura de Computador basada en un Lenguaje de Alto Nivel

Resulta interesante el hecho de que la
implementacin
en
hardware
de
funcionalidades de alto nivel disminuye la
distancia entre la mquina y el constructor
de compiladores, que se da cuenta de que su
labor cambia.
Implementar los comandos ms bsicos del
lenguaje de alto nivel utilizando assembly, al
encontrarse con complejas funciones de alto
nivel ya pueden ser realizadas por el hardware;
que el mapeamiento que estaba acostumbrado
a hacer de una instruccin a muchas se ha
transformado en uno-a-uno.
Esto es lo que se llam HLLCA, Arquitectura de Computador basada
en un Lenguaje de Alto Nivel (High Level Language Computing
Architechture), donde parecera no existir diferencia entre un
programa en el assembly de una mquina y un programa en un
lenguaje como C. Esta arquitectura representa el concepto de CISC
llevado al extremo.

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Instrucciones Complejas
la existencia de un lenguaje de alto nivel en un computador cuyo lenguaje
assembly posee al menos las siguientes instrucciones:
MOVER [registro de destino, integer o registro de origen] :
Toma un valor, entero o el contenido de otro registro, y lo ubica en el registro de
destino.
As, MOVER [D, 5] pondra un nmero 5 en el registro D. MOVER [D, E] tomar el
valor almacenado en el registro E y lo copiar en D.
MUL [registro de destino, entero o registro multiplicando] :
Toma el contenido del registro de destino, lo multiplica por el nmero entero o el
contenido del registro entregado como segundo parmetro y pone el resultado en
el registro de destino.
As, MUL [D, 70] multiplicar el contenido de D por 70 y pondr el resultado en D.
MUL [D, E] multiplicar el contenido de D por el contenido de E y pondr el
resultado en D.

Plataformas Tecnolgicas

Ejemplo:
Podemos imaginar entonces un
lenguaje de alto nivel, al que
llamaremos HLL, inmerso en un
sistema en el cual la operacin
elevar un nmero a la cuarta
potencia
es
una
operacin
recurrente. La tabla 1 muestra cmo
sera la traduccin HLL assembly
que se hara en esta mquina.

Lenguaje de Alto Nivel (HLL) y Assembly CISC

HLL

A = 20;
B = CUARTA (A);

assembly

MOVER [A, 20]

MUL [A, A]
MUL [A, A]
MOVER [B, A]

El enfoque CISC sugerira la inclusin de una nueva instruccin en este sistema:

CUARTA [registro de destino, entero o
registro base] :
Toma el contenido del entero o registro base
y lo eleva a su cuarta potencia, para luego
poner el resultado en el registro de destino.
CUARTA [D, E] toma el valor que hay en E,
lo eleva a la cuarta potencia y pone el
resultado en D, y CUARTA [D, 10] obtiene
104 y lo almacena en D.

HLL

A = 20;
B = CUARTA (A);

assembly

MOVER [A, 20]

CUARTA [B, A]

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Plataformas Tecnolgicas

Direccionamiento de Datos

El acceso a los datos en una

mquina CISC toma la filosofa
asociada
inicialmente
a
las
instrucciones, es decir, se entiende
que se facilita la tarea de
programacin minimizando el
uso de instrucciones de bajo
nivel,
y
proporcionando
instrucciones que sean capaces
de hacer el mximo posible

Plataformas Tecnolgicas

Direccionamiento de Datos
Realizar la siguiente operacin en nuestro
HLL:
X=X*Y
donde la variable X se refiere al espacio de
memoria en la posicin 2:3, mientras que la
variable Y corresponde a la posicin de memoria
5:2.
X=X*Y

MOVE [A, 2:3]

MOVE [B, 5:2]
MUL [A, B]
MOVE [2:3, A]

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Arquitectura CRISC
Combinacin de CISC
con RISC

Complex-Reduced
Instruction Set
Computer

Mviles: ARM vs. X86

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Plataformas Tecnolgicas

Elaborar un organizador visual de:

La diferencia de la Arquitectura
RISC Vs CISC

Plataformas Tecnolgicas

RISC vs. CISC

puntos de comparacin de las filosofas de desarrollo asociadas a los
procesadores RISC y CISC
CISC

RISC
Estrategias en Precio/Rendimiento

Precio: Mover la complejidad desde el Software hacia

el Hardware.
Rendimiento: El cdigo de los programas debera ser
pequeo, frente a un elevado nmero de ciclos de
reloj por instruccin.

Precio: Mover la complejidad desde el hardware hacia

el software.
Rendimiento: El cdigo de los programas
crece, pero bajan los ciclos de reloj para cada
instruccin.

Decisiones de Diseo
Grande y variado set de instrucciones, que
incorpora desde instrucciones muy simples para
tareas elementales, hasta instrucciones complejas,
que son casi propias de un lenguaje de
programacin de alto nivel.
Soporte en hardware para los lenguajes de alto
nivel.
Direccionamiento de Memoria a Memoria.
Unidad de control en microcdigo.
Pocos registros.

Instrucciones simples, que utilizan pocos ciclos de

reloj. Se corresponden con las instrucciones en
microcdigo de una mquina CISC.
El soporte de los lenguajes de alto nivel est a
cargo del software.
Mecanismos de direccionamiento muy simples,
basados en operaciones de registro a registro, y
operaciones de carga y recuperacin de datos hacia
y desde la memoria.
Muchos registros en un procesador.
Se utiliza pipeline para reducir el nmero de ciclos
de reloj por cada instruccin.

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GRACIAS.

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