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Figura 1. Circuito a utilizar para representar la curva caracterstica de drenador de un transistor NMOS. Indicaciones: Utilizar los componentes VDC (librera SOURCE) para las fuente de tensin continua y el componente MbreakN (librera BREAKOUT) para el transistor (figura 2.a). Este modelo permite dar valores a los parmetros del NMOS. Para ello, editar el modelo Spice del transistor siguiendo las siguientes instrucciones: 1) Seleccionar el transistor. 2) Elegir la opcin de men: Edit Pspice model. 3) En la ventana del Editor de Modelos de PSpice que se abre, indicar el valor de los parmetros de nuestro transistor (KP, LAMBDA y VTO) tal y como se indica en la figura 2.b.
Drenador
Puerta
Fuente
Figura 2. a) Terminales del componente MbreakN. b) Editor de modelos de Pspice. Especificacin de los valores de KP, VTO y LAMBA del NMOS.
Prctica 6
Figura 4. Ventana de edicin de propiedades. Visualizacin en el esquemtico de los parmetros W y L. Una vez especificado el transistor, se debern indicar los parmetros del anlisis que Spice debe realizar con el circuito. Para representar las curvas caractersticas de drenador se har un barrido en continua (DC SWEEP) de la fuente de tensin VDS entre 0V y 10V con incrementos de 0.01V y este anlisis se repetir variando la fuente de tensin VGS para valores de 0V a 5V con incrementos de 1V mediante un barrido paramtrico (PARAMETRIC SWEEP). En la figura 5 se indica las pestaas para la programacin del anlisis.
Figura 5. Ventana de especificacin de anlisis a realizar sobre el circuito. Programacin del anlisis estndar Primary Sweep y junto con las iteraciones a realizar sobre el mismo mediante Parametric Sweep.
Prctica 6
Curva caracterstica de drenador del NMOS (W=160m, L=2m, KP=50A/V2, =0.05, Vto=2V)
(insertar imagen con el resultado de la simulacin)
Prctica 6
1.3. Variacin de la caracterstica de transferencia con la tensin umbral (VTO). Repetir el ejercicio anterior variando la tensin umbral del transistor VTO. Para ello, se deber programar adems del barrido en continua del apartado 1.2 un barrido paramtrico (PARAMETRIC SWEP) del parmetro VTO del modelo del transistor NMOS. En la figura 7 se indica el perfil de simulacin a aadir. Capturar las grficas obtenidas y observar como vara el punto de transicin entre el corte y la saturacin en la caracterstica de transferencia. Incluir en la grfica etiquetas (utilizando el men de Probe: Plot Label Text) sobre cada curva indicando el valor de VTO correspondiente.
Figura 7. Perfil de simulacin del barrido paramtrico del parmetro VTO del modelo de transistor NMOS de nombre MiNMOS.
Prctica 6
2. Curvas caractersticas de un transistor PMOS (MOSFET de acumulacin de canal p) Nota: si te sale un cuadro de texto como con opciones para marcar extrao al simular,
revisa los signos de los ejes para simular. Indica que hay una incoherencia
2.1. Trazar con SPICE las curvas caractersticas de drenador de un transistor PMOS Repetir el ejercicio 1.1 para obtener mediante Spice la grfica de las curvas caractersticas de drenador de un transistor PMOS que tiene W=160m, L=2m, KP=20A/V2, =0.05, y Vto = -2 V. Dibujar a escala las curvas caractersticas de drenador para vGS = 0, -1, -2, -3, -4, y -5 V. Indicaciones: Utilizar ahora el componente MbreakP (librera BREAKOUT) para el transistor PMOS (figura 8.a). Este componente permite dar valores a los parmetros del PMOS. Para ello, editar el modelo Spice del transistor siguiendo las instrucciones del apartado 1.1. Especificar el valor de los parmetros del transistor (KP, LAMBDA y VTO) tal y como se indica en la figura 8.b. La especificacin de los valores geomtricos de anchura y longitud de canal (W y L) se realizar a travs de la ventana de edicin de propiedades del transistor tal y como se hizo en el apartado 1.1 para el NMOS.
Drenador
Puerta
Fuente
a) b) Figura 8. a) Componente MBreakP. Terminales. b) Editor de modelos de Spice. Especificacin de los valores de KP, VTO y LAMBA del PMOS.
Prctica 6
Curva caracterstica de drenador del PMOS (W=160m, L=2m, KP=20A/V2, =0.05, Vto=-2V).
(insertar imagen con el resultado de la simulacin)
2.2. Trazar con SPICE la caracterstica de transferencia de un transistor PMOS Obtener la caracterstica de transferencia o relacin entre la entrada (VGS) y la salida (ID) del transistor PMOS. Para ello, mantener fija la tensin VDS a -10V y realizar un Barrido en Continua (DC SWEEP) de la tensin VGS entre 0 y -10V. Representar la curva ID=f(VGS) obtenida e indicar sobre la misma las zonas de funcionamiento del transistor. Caracterstica de transferencia ID = f(VGS) del PMOS (W=160m, L=2m, KP=20A/V2, =0.05,
Vto=-2V)
(insertar imagen con el resultado de la simulacin)
Prctica 6
Figura 9. Perfil de simulacin del barrido paramtrico del parmetro VTO del modelo de transistor PMOS de nombre MiPMOS.
Caracterstica de transferencia ID = f(VGS) del PMOS para VTO=-2V, -3V y -4V (W=160m,
(insertar imagen con el resultado de la simulacin)
Prctica 6
Laboratorio de Fsica: Fundamentos de Electrnica 4. Punto de trabajo y amplificacin con transistores MOS
En este apartado se realizar la simulacin mediante Spice del ejercicio propuesto para casa de la pgina 38 de las transparencias de la asignatura. Se pretende comprobar el punto de trabajo del transistor mediante el Anlisis del Punto de Trabajo (BIAS POINT), as como la capacidad amplificadora del circuito mediante el Anlisis en Tiempo o Transitorio (TRANSIENT ANALYSIS). 4.1. Calculo del punto de trabajo de un transistor MOS (Bias point) Sea el circuito amplificador en fuente comn simplificado de la figura 10. Los generadores de tensin continua VGG y VDD polarizan el NMOS en un punto de trabajo adecuado para que pueda tener lugar la amplificacin de la seal de entrada vin(t). En este apartado se pretende determinar mediante SPICE el punto de trabajo (IDQ yVDSQ) del transistor NMOS, siendo VDD=15V, VGG = 3 V, RD = 1 k y vin(t) = 0V. Los parmetros del transistor son: KP = 50 A/V2, Vto =1 V, =0, L = 10 m, y W = 400 m (ver definicin del modelo en la figura 11). Para ello, se deber utilizar el anlisis BIAS POINT y se programar tal y como se indica en la figura 12. Los resultados del punto de trabajo se observarn en el fichero de salida *.OUT (el anlisis BIAS POINT no genera informacin grfica, solamente salida en modo texto en el fichero *.OUT). Se puede abrir el fichero de salida (*.OUT) desde el editor grfico Probe utilizando la opcin de men ViewOutput File o bien mediante el icono indicado en la figura 13. En dicha figura tambin se indica un ejemplo de fichero de salida con el punto de trabajo.
Figura 11. Editor de modelos de Pspice. Especificacin de los valores de KP, VTO y LAMBA del NMOS.
Figura 12. Ventana de especificacin de anlisis a realizar sobre el circuito. Programacin del anlisis estndar BIAS POINT.
Prctica 6
Figura 13. Fichero de salida con informacin acerca del punto de trabajo de un transistor NMOS.
Punto de trabajo del transistor Extracto del fichero de salida *.OUT en donde aparece reflejado (insertar texto con el resultado de la simulacin)
Prctica 6
Figura 14. Ejemplo de visualizacin de las tensiones y corrientes continuas de un circuito sobre el esquemtico en Capture CIS.
4.2. Amplificador en fuente comn simplificado. Anlisis en el tiempo En este apartado se pretende comprobar la capacidad amplificadora del transistor NMOS. Para ello se simular en el tiempo (TRANSIENT ANALYSIS) el circuito de la figura 10, aplicando a la entrada del mismo una seal vin(t) = sen (2000t). Realizar una simulacin en el tiempo durante 5 perodos y representar las seales de entrada vin(t) y salida vDS(t) obtenidas. Calcular los valores mximo y mnimo de vDS(t): VDSmax y VDSmin. Estimar la ganancia en tensin del circuito. Indicaciones: Para generar vin(t) se utilizar el componente VSIN (Librera SOURCE). Se puede utilizar el parmetro OFFSET de dicha fuente para establecer tambin el nivel de continua VGG=3V y suprimir la fuente de tensin DC VGG especfica.
VDS max = 14 V
VDS min.= 6 V
Ganancia en tensin:
(14-6)/2=4
Prctica 6
10
Tensin de entrada vin(t) y de salida vDS(t) en funcin del tiempo durante 5 ciclos
(insertar imagen con el resultado de la simulacin)
Aplicar ahora una seal de entrada senoidal de frecuencia 1KHz, amplitud 7.5V y OFFSET 7.5V de forma que el transistor pase por las 3 zonas de funcionamiento (CORTE, SATURACION Y OHMICA). Realizar una simulacin en el tiempo durante 5 perodos y representar las seales de entrada vin(t) y salida vDS(t) obtenidas. Representar la funcin de transferencia vDS = f(Vin) cambiando la seal del eje x y utilizando la seal de entrada en lugar del tiempo. Identificar razonadamente las zonas de funcionamiento del transistor en ambas curvas. Tensin de entrada vin(t) y de salida vDS(t) en funcin del tiempo durante 5 ciclos
(insertar imagen con el resultado de la simulacin)
Prctica 6
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Figura 15. Ventanas involucradas en el cambio de variable del eje X a la tensin VDS del NMOS.
Introduciremos los diseos en CAPTURE CIS y realizaremos una simulacin del punto de trabajo.
Prctica 6
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R1 = 1.5 M R2 = 1 M RD = RS = 2.4 K
Figura 16. Enunciado del ejercicio de diseo a comprobar junto con la solucin determinada en clases.
Punto de trabajo del transistor (ID, VDS, VGS) Extracto del fichero de salida *.OUT en donde aparece reflejado (insertar texto con el resultado de la simulacin)
Prctica 6
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R1 = 1 M R2 = 2 M RD = 0 RS = 3.9 K
Figura 17. Enunciado del ejercicio de diseo a comprobar junto con la solucin determinada en clases.
Punto de trabajo del transistor (ID, VDS, VGS) Extracto del fichero de salida *.OUT en donde aparece reflejado (insertar texto con el resultado de la simulacin)
Prctica 6
14
Figura 18. Enunciado del ejercicio propuesto. Emplear para el transistor JFET el componente JBreakN (LIBRERA BREAKOUT). En la figura 19.a se puede ver dicho componente. Seguir los pasos indicados en ejercicios anteriores para definir los valores de los parmetros del JFET (figura 19.b). Con objeto de obtener las grficas de las curvas caractersticas de drenador se debe realizar un anlisis de barrido en continua (DC SWEEP) de la tensin drenador fuente vDS entre 0 y 10V y repetir dicho anlisis para vGS = 0, -1, -2 y -3 V mediante un anlisis de barrido paramtrico (PARAMETRIC SWEEP). En la figuras 20 y 21 se muestran respectivamente el esquema del circuito empleado para obtener las curvas caractersticas y los parmetros empleados en la simulacin.
Drenador
Puerta
Fuente
Figura 19. a) Terminales del componente JBreaKN. b) Editor de modelos de Pspice para especificar los valores de BETA, VTO y LAMBA del JFET.
Prctica 6
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VDS
0Vdc
Figura 20. Esquema del circuito empleado para obtener las curvas caractersticas de drenador
Figura 21. Perfil de simulacin para obtener las curvas caractersticas de drenador. Ejecutar la simulacin y obtener las curvas de drenador del transistor. Incluir etiquetas (utilizando el Men de Probe: Plot Label Text ) sobre cada curva indicando el valor de VGS.
Prctica 6
16