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EL AMPLIFICADOR MULTIETAPA
Cuando nos refererimos a un amplificador, estamos hablando de un circuito capaz de procesar la
las seales de acuerdo a la naturaleza de la aplicacin. El amplificador sabra extraer informacin de
toda seal, de tal manera, que permita mantener o mejorar las caractersticas del sensor o
transductor utilizado para nuestra aplicacin. Por ejemplo: Si nuestra aplicacin esta inmersa en
algn tipo de ruido, el amplificador no deber amplificar el ruido, es ms, debe atenuarlo de toda la
seal y/o del medio imperante. La tarea se deber realizar sin distorcionar la seal, sin perder
informacin, ni inteligencia. Un criterio universal al plantearse el diseo de un amplificador, consiste
en, seleccionar la primera etapa de este como un pre amplificador, es decir, como un amplificador
que permita preparar adecuadamente la fuente de seal para ser posteriormente procesada y
amplificada. Una segunda etapa, consistira netamente en obtener amplificacin de o las variable
involucradas. En muchos casos, y con el fin de evitar niveles de saturacin, se reserva ms de una
etapa para esta tarea. Por regla general, la etapa final ser exclusivamente un etapa de potencia. Esta
etapa, es en realidad la que permite la materializacin de nuestra aplicacin en un ambiente
completamente ajeno a las pequeas seales. Comunmente, es un ambiente industrial,
agroinductrial, del ambito de la medicina o simplemente un ambiente bajo el dominio de la
electrnica de consumo. No debe dejarse de lado, el hecho de que las etapas iniciales y finales,
tambin son las responsables de las caractersticas de impedancia que ofrecer nuestro amplificador.
En sintesis, un amplificador no es un sistema simple de anlizar y disear. Es un sistema complejo,
pero con notables facilidades para el diseador, si este ha logrado una buena metodologia en el
marco teorico - practico de los circuitos electrnicos elementales.
Para la interconexin de las etapas se debe tener en cuenta la relacin entre la ganancia y el ancho de banda, cuyo producto es
constante.
74
CAPITULO III
TIPOS DE ACOPLAMIENTO
En cuanto al dispositivo que utilicemos para interconectar las etapas, nos permitir definir el tipo de
acoplamiento a utilizar. Los dispositivos usuales de acoplamiento son: Cable, condensador, y
transformador.
Vcc
etapa
Vi
etapa
acoplamiento
etapa
acoplamiento
Vo
ACOPLAMIENTO DIRECTO
Consiste bsicamente en interconectar directamente cada etapa mediante un cable. Presenta buena
respuesta a baja frecuencia. Tipicamente se utilizan para interconectar etapas de emisor comn con otras
de seguidor de emisor.
Ejemplo:
+VCC
R1
Vi(t)
RC
VBE
R2
RE1
V0
RE2
La etapa 1, se disea segn los criterios ya vistos, por lo tanto, conocemos el punto de operacin para cada
una de las variables del circuito. Para disear la segunda etapa se debe considerar:
IC1
IB1
Vth
Rth
VBE
+VCC
IB2
VBE
RE1
VCC + R C (I B2 + I C1 ) + Vbe 2 R E 2I E2 = 0
I B2 << I C
I E2 = -(I C2 + I B2 )
75
RC
IE1
RE2
VCC
IE2
CAPITULO III
VCC + RC I C1 + VBE + RE 2 ( I C 2 + I B 2 ) = 0
Vcc + Rc I c1 + VBE2 + RE 2 ( + 1) I B 2 = 0
I
B2
V
R I
V
CC
BE
C C1
(1 +
)R
E2
ACOPLAMIENTO CAPACITIVO
Permite desacoplar los efectos de polarizacin entre las etapas. Permite dar una mayor libertad al diseo.
Pues, la polarizacin de una etapa no afectar a la otra. En AC:
Vi
Av =
No1
Vi1
V0 V0n
=
.........
Vi Vin
V01
Vi
1
No2
Vo1
Vi2
Vi1
Vi
V0
=
V
i
No3
Vo2
Vi3
Vo3
V0
Z1
Z2
ZL
Podemos utilizar:
V2 N 2
=
V1 N 1
i2 N1
=
i1 N 2
Z1 N1
=
Z 2 N 2
CONFIGURACIN DARLINTONG
Corresponde a dos etapas seguidor emisor. Presenta alta impedancia de entrada, adems produce un efecto
multiplicativo sobre la corriente de emisor de la etapa final.
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CAPITULO III
IC1
IB1
VCE1 IB2
VBE
IC2
VCE2
VBE
+VCC
IC1
RB
IB1
RB
Vi
RE
VBE
VCE1
IC2
IB2 VCE2
VBE
RE
V0
VCC
VCC 2VBE
RB + ( 1 + 1 )( 2 + 1 )RE 2
AMPLIFICADOR DIFERENCIAL
Se define as, a la configuracin amplificadora en que la seal de salida corresponde a la diferencia entre
dos seales de entrada:
Vi1
Vi2
Amplificador
Diferencial
77
V02
V01
CAPITULO III
(Vi1 + Vi2 )
2
Nota:
Ad
Ac
Para que un amplificador diferencial slo responda a la entrada diferencial, logicamente debe ocurrir:
Ad >>Ac.
Se define Razon de Rechazo en Modo Comn a la cantidad:
RRMC =
Ad
Ac
Vi + Vi2
V01 = Ac 1
2
V0
Ac = 1
Vi
Notar que si en V01 las entradas se presentan en desface de 180, entonces Vo1 = 2 Ad Vi2 , luego:
Ac =
V01
2Vi
CONFIGURACION
Si los parmetros de circuito y de los transistores para cada etapa, son identicos, entonces para identica
seal de entrada la seal Vo debe ser nula. Lo cual se conoce como: circuito balanceado.
+VCC
RC
RC
V0
Vi1
Vi2
RE
VBB
78
CAPITULO III
V BE1 RE I E V BB = 0
V BE1 RE ( I E1 + I E2 ) VBB = 0
Con ambos transistores iguales:
VBE1 - 2R E I E VBB = 0
I E = -(I C + I B )
VBE1 + 2R E (I C + I B ) VBB = 0
Finalmente:
I BQ =
VBB VBE1
2 RE ( + 1)
; IE =
- ( + 1)(VBB VBE1 )
2R E ( + 1)
(VBB VBE1 )
2 RE
En la prctica lo que se desea es que la IE sea independiente de los transistores y de valor constante.
Tambien se desear que RE sea lo ms grande posible. Cumpliendo lo anterior se obtendr una RRMC de
valor alto y con ello, una respuesta diferencial ms proxima al ideal de diferencia.
Acontinuacin demostraremos que un gran valor de RE, mejora la respuesta de un amplificador diferencial.
Solucin:
Si la calidad del amplificador, se mide segn el parmetro RRMC, entonces:
RC
h ie
Vi1
RC
h feib1
h feib2
RE
Entonces:
(v
i1
+ vi2
En Modo Comn:
Vi1 = Vi2 = Vi
Ac =
v01
vi
Del circuito:
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V0
h ie
Vi1
CAPITULO III
ib1 = ib2 = ib
y ie1 = ie2 = ie =
iet
= (1 + h fe )ib
Luego:
v01 = h feib RC
por malla de entrada:
vi = hie ib RE iet
Por lo tanto:
h fe RC
hie + 2 RE (1 + h fe )
En Modo Diferencial:
Vi1 = Vi2
Ad =
v01
2vi1
Dado que ambas seales estan defasadas entre si, entonces: ib1 = ib2 y ie1 = ie2 , luego:
iet = 0 ,
Obteniendse:
vi = hie ib1
h fe RC
Ad =
2hie
Finalmente:
RRMC =
hie + 2 RE (1 + h fe )
2hie
Observando que:
hie 2 RE (1 + h fe )
Entonces:
80
CAPITULO III
Ad R E (1 + h fe )
Ac
hie
Lgicamente, mientras mayor resulte RE, tanto mayor, ser la RRMC y mejorar notablemente la calidad
del amplificador diferencial.
En la prctica es dificil lograr el requisito anterior, debido a:
-
El problema se resuelve, si reemplazamos RE por un circuito que proporcione una fuente de corriente
constante.
El siguiente circuito cumple lo anterior:
Iet
Ib3
RB
RE
-VBB
iet = ic 3
RB I B3 + VBE3 RE I E3 VBB = 0
I E3 = ( 1 + )I B3
VBB Vbe3
I B3 =
RB + ( 1 + )RE
Por lo tanto:
I Et = ( 1 + )
VBB VBE3
RB + ( 1 + )RE
I Et =
VBB VBE3
RE
81
CAPITULO III
RESPUESTA EN FRECUENCIA
La respuesta en frecuencia de todo amplificador transistorizado consta de tres reas, bien definidas:
A
0.7A
fL
fH
a) Una regin de baja frecuencia, caracterizada por la respuesta de un filtro pasa altos.
b) Una regin independiente de la frecuencia (rea central del grfico).
c) Una regin de alta frecuencia, caracterizada por la respuesta de un filtro pasa bajos.
Es caracterstica de la regin de baja frecuencia su frecuencia de corte inferior, denotada por fL.
Anlogamente, la regin de alta frecuencia, es parametrizada por su frecuencia de corte superior, denotada
por fH.
Se define: Ancho de banda BW a la diferencia aritmtica entre ambas frecuencias de corte. En la practica,
BW es equivalente a fH.
Para evaluar la respuesta en frecuencia de un amplificador monoetapa, supongamos el siguiente circuito:
+ VCC
R1
RC
CC
CC
Vi(t)
RL
RE
R2
V0
CE
rx
b
r
C
+
v
-
c
gmv
C
C
rx
CAPITULO III
Logicamente, en baja frecuencia C y C equivalen a un circuito abierto, razn por la cual, el circuito
hbrido ser:
CC
Vi
RTH
rx
CC
+
V
RE
gmV
RC
RL
CE
Vo
s
=
Vi s + s b
Para obtener la frecuencia del polo basta hacer nulo el denominador, es decir:
Vo
=
Vi
s
s+
1
RC
1
RC
1
1
S+
= 0 SC + = 0
RC
R
YC + YR = 0 YT = 0
Sb = -
Se concluye que para obtener la frecuencia del polo y con ello el valor del condensador, bastar hacer nula
la admitancia total vista por dicho elemento.
DETERMINACIN DE fH
Para el mismo circuito monoetapa, su equivalente en alta frecuencia ser:
83
CAPITULO III
Ri
rx
C
+
Vi
RTH
gmV
RC
Notar que:
RTH>>Ri
Esto es posible, debido a que en alta frecuencia la Ri de los generadores de seal, es por norma: 50[].
RTH>> rx + r
Entonces:
R i + rx
C
+
Vi
V C
gmV
RC
gmV
gc
C
+
Vi Gi
Gi g
V C
-
Entonces:
[G` + g
i
+ S (C + C v SC V0 = Vi G`i
SC v + ( g C + SC ) V0 = gm v
( SC + g m ) v + ( g C + SC ) V0 = 0
V0 =
G` i + g + S( C + C )
SC + g m
G` i + g + S( C + C )
SC + g m
V i G` i
0
SC
g C + SC
Por lo tanto:
( g m SC ) G` i
V0
=
Vi
G` i + g + S( C + C )( g C + SC ) + SC ( g m SC )
84
CAPITULO III
( g m SC ) G` i R C
V0
=
Vi
( G` i + g + S( C + C ))( 1 + SC R C ) + SC ( g m SC )R C
( g m SC ) G`i RC
V0
=
2
Vi
C C RC S + (C + C (1 + (G`i + g m + g ) RC )) S + (G`i + g )
( g m SC ) G` i R C
V0
=
Vi
C C R C S 2 + C T S + ( G` i + g )
SC << g m
SC u << g m
Por lo tanto:
S 2C C << g m
Finalmente:
( g m G` i R C
V0
=
V i [C T S + ( G` i + g ) ]
AV
wH
w
Lo cual representa un slo polo. A la inversa, utilizando la funcin de transferencia, podemos deducir un
circuito equivalente, resultando:
+
Vi Gi
Gi g
V CT
-
SH=
( G` S + g )
CT
S H = wH
85
gmV
RC
CAPITULO III
wH =
( G` S + g )
CT
wH =
Donde:
Rj,
Cj
Es la resistencia vista por el condensador j-simo con todas las dems capacidades en circuito
abierto.
Puede ser la capacidad C o C de la etapa que esta bajo el anlisis. Es fcil deducir, cual de ambas
corresponde.
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