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68

MULTIPLEXORES- DEMULTIPLEXORES
DEMULTIPLEXORES
Un Demultiplexor es un circuito lgico combinatorio que recibe
informacin por una sola lnea de entrada y transmite esta
informacin en una de las 2n lneas posibles de salida; la seleccin de
una lnea de salida especfica se controla por los valores de los bits de
las n lneas de seleccin.
PROBLEMA: Disee un Demultiplexor de una lnea de entrada a cuatro
lneas de salida.

(n)

A
0
0
1
1

B
0
1
0
1

S0
D
0
0
0

S1
0
D
0
0

S2
0
0
D
0

S3
0
0
0
D

Funciones
S0=A*B*D
S1=A*B*D
S2=A*B*D
S3=A*B*D

La mayora de los circuitos integrados decodificadores, incluye una a

ms entradas de activacin (Enable), para controlar la operacin de
dicho circuito integrado. Por lo anterior un Decodificador con una
entrada de habitacin puede funcionar como Demultiplexor.
PROBLEMA: Configure un demultiplexor de 4x16, mediante dos
demultiplexores de 3x8 lneas, con lnea de activacin cada uno de
ellos.

Ing. Celedonio E. Aguilar Meza

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69

MULTIPLEXORES
Multiplexar significa transmitir una gran cantidad de canales o lneas.
Un Multiplexor digital es un circuito combinatorio que selecciona
informacin binaria de una de muchas lneas de entrada para dirigirla
a una sola lnea de salida.
La seleccin de una lnea de entrada en particular es controlada por el
conjunto de lneas de seleccin, normalmente hay 2n lneas de entrada
y 1 lnea de salida.
NOTAS:

Un Multiplexor se llama tambin selector de datos, ya que

selecciona una de muchas entradas y gua la informacin binaria

a la lnea de salida.
Normalmente
los
Multiplexores
tienen
una
entrada
de
habilitacin (strube), esta puede ser utilizada para expandir un
arreglo de Multiplexores mediante circuitos integrados lneas de
entrada limitado.
Circuito que sirve para manejar datos.

EJEMPLO: Se muestra a continuacin un Multiplexor de 4 lneas a 1

lnea o de 4x1.

Ing. Celedonio E. Aguilar Meza

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70

Y=I0*S1S0+I1*S1*S0+I2*S1*S0+I3*S1S0

TARE:
Investigacin: Analice el funcionamiento del siguiente
circuito lgico, y en base al manual de circuitos integrados explicar de
que circuito se trata.

Ing. Celedonio E. Aguilar Meza

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GENERACIN DE FUNCIONES CON CIRCUITOS

MULTIFLEXORES
Cualquier funcin booleana puede implementarse con un Multiplexor
de 2n1 lneas a 1 lnea.
Procedimiento.
1.

Primero se expresa la funcin en su forma de suma de trminos

mnimos, se asume la secuencia ordenada de variables escogidas.
Para los trminos es A, B, C,, (a, b, c,) donde A es la variable
de la extrema izquierda a una secuencia ordenada de n variables y
B, C, D,, son las n-1 variables restantes, se conectan las n-1
variables a las lneas de seccin del Multiplexor con b conectada a
una lnea de seleccin de mayor orden, C a la siguiente lnea
menor de seleccin y as sucesivamente hasta la ultima variable la
cual se conecta a la lnea de seleccin de ms bajo orden (S0).

2.

Lstense las entradas del Multiplexor y bajo ellas los trminos

mnimos en dos columnas, la primera fila incluye todos los
trminos mnimos en los cuales A es complementada y la segunda
fila, todos los trminos mnimos con A no complementada, de la
manera mostrada en la figura.

3.

Encirrense en un crculo todos los trminos que hacen verdadera

la funcin, e inspeccinese cada columna separadamente. Si los
trminos mnimos en una columna no estn encerrados en crculo,
aplquense cero a la entrada correspondiente del Multiplexor.

4.

Si el termino mnimo inferior esta encerrado en un circulo y el

superior no lo esta, aplquense A a la entrada correspondiente
del Multiplexor.

NOTA: Un Multiplexor (MUX), se llama tambin un selector de datos

ya que selecciona una de muchas entradas y gua la informacin
binaria a la lnea de salida.
1. Implemente la siguiente funcin con un Multiplexor.
F(A,B,C,D,)=4(0,1,3,4,8,9,15), Conecte B, C, y D a las lneas de
seleccin del MUX.
NOTA: Como F(A,B,C,D), se necesita un MUX de 2n-1x1 lneas, n = al
Nmero de variables de la funcin.

Ing. Celedonio E. Aguilar Meza

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72

2.- Implemente las siguientes funciones tomando en cuenta que las

variables binarias son las mismas. Un registro de salida en un
paralelo de A0 a A3 contiene un dgito codificado en BCD natural,
disear un sistema con:
I.

Multiplexores que genere las siguientes funciones binarias.

II.

Decodificadores.

a) f1 adoptara el estado 1 si el dgito contenido en el registro es

divisible por 2 y el estado 0 en caso contrario.

b) f2 adoptara el estado 1 si el dgito contenido en le registro esta

comprendido entre 1 y4, ambos inclusive, y en el estado 0 en el
caso contrario.

c) 3 adoptara el estado 1 si el dgito contenido en el registro es

divisible por 4 y 0 en caso contrario.

Ing. Celedonio E. Aguilar Meza

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0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
I0
a3 0
a3 8
a3

I1
1
9
0

a3
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1

a2
0
0
0
0
1
1
1
1
0
0
1
1
1
1
1
1

PARA f1
I2 I3 I4
2
3
4
10 11 12
1
0
1

a1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1

I5 I6
5
6
13 14
0
1

I0
0
a3
a3 8
a3

I1
1
9
0

a0
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
I7
7
15
0

73

f1
0
0
1
0
1
0
1
0
1
0
X
X
X
X
X
X

f2
0
1
1
1
1
0
0
0
0
0
X
X
X
X
X
X

f3
0
0
0
0
1
0
0
0
1
0
X
X
X
X
X
X

I0
a3 0
a3 8
0

PARA f3
I2 I3 I4
2
3
4
10 11 12
0
0
1

I5
5
13
0

BCD Natural

I1
1
9
a3

I6
6
14
0

PARA f2
I2 I3 I4
2
3
4
10 11 12
1
1
1

I5
5
13
0

I6
6
14
0

I7
7
15
0

Tare: Obtener las funciones de salida e implementar el circuito.

Ing. Celedonio E. Aguilar Meza

Circuitos Digitales

I7
7
15
0