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Clase ADC-DAC - Version 1
Clase ADC-DAC - Version 1
Analógico/digital
Por Dr. Ing. Ariel Lutenberg
011100110
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Conversores
Analógico/digital
Organización de la clase:
1. Repaso de
conversión A-D
2. Conversores
A-D
3. Conversores
D-A
1. Repaso de
conversión A-D
1. Introducción a conversión A-D
Señal analógica y señal digital
• La amplitud de una señal analógica puede tomar cualquier valor real.
• Una señal digital toma valores discretos de un conjunto predeterminado.
1. Introducción a conversión A-D
Ventajas de la señal digital
1. La señal puede replicarse sin perdida de calidad (CD, repetidores, etc).
2. Pueden detectarse y corregirse errores en la señal (ej. CD/DVD, CRC, etc.)
3. Procesamiento digital y compresión de la señal (MP3, JPG, etc.)
• Error de • Error de
offset ganancia
• Error de • Error de
alinealidad alinealidad
1. Introducción a conversión A-D
Terminología
Resolución del conversor
Es la mínima variación en la señal de entrada que puede detectar el ADC.
resulta: dvi
2 fA cos(2 ft ) 2 fA
dt
2A 1
2 fA f 12.4 Hz Esto es muy bajo!
2 n tc 2 tc
n
Ejemplo
Se tiene una señal con rango -10 a 10 Volts y un conversor con rango 0-5Volts.
- Los circuitos con operacionales son muy adecuados para “escalar” señales.
- Hoy en día esto viene muchas veces integrado en los ADCs.
1. Introducción a conversión A-D
Características de los ADCs
Características de las entradas analógicas
de los conversores A-D:
Tipo de señal (tensión o corriente)
Polaridad (Unipolar, bipolar)
Número de canales
Rango de señal
Tensión de referencia (interna, externa)
Clock del conversor (interno, externo)
Deriva de la tensión de referencia
La salida de la cadena de
comparadores es
inherentemente digital.
La cadena de resistores
imposibilita más de ~8 bits
de resolución (255 resistores)
y/o impone un costo muy elevado.
2. Conversores A-D
a. ADC – Flash converters (ejemplo)
2. Conversores A-D
a. ADC – Flash converters (importancia del layout en la velocidad)
2. Conversores A-D
b. ADC – Time Interleaved
La idea de estos conversores (TI-ADC) es usar un sistema de M canales en
paralelo, que convierten alternativamente a la señal y alimentan a un MUX.
Los resultados
son muy
impresionantes
(ejemplo del
“Advanced
Filter Bank” del
AD12400):
2. Conversores A-D
c. ADC – Succesive Aproximation
- Es apto para aplicaciones de baja
resolución y velocidad.
- Por su bajo costo se suele integrar
en la mayoría de microcontroladores
Su algoritmo interno es el siguiente:
2. Conversores A-D
c. ADC – Succesive Aproximation (ejemplo)
2. Conversores A-D
d. ADC – Pipelined subraging
Utilizan una estructura en cascada, tipo tubería (pipeline), donde la conversión se
realiza sucesivamente sobre fracciones cada vez menores de Vin (subraging).
Por ejemplo, en un ADC subraging de 4 etapas de rango 0-1 Volts y una señal de
entrada de 0.7 Volts el funcionamiento sería el siguiente:
1011
Ejercicio: repitan ustedes para el caso Vin = 0.4 Volts.
2. Conversores A-D
d. ADC – Pipelined subraging (ejemplo)
Para un ADC subraging de 4 etapas de 1 bits y de rango 0-1 Volts, y una señal de
entrada de 0.4 Volts indique las tensiones y conversiones en cada etapa.
Resolución
0.8V
0.3
0.6V
0.1
0.4V
-0.1
0.2V
-0.3
1011
0 1 1 0 Output = 0110
2. Conversores A-D
d.ADC – Pipelined subraging
Implementación para más bits:
VIN C : 1 - 0
VIN C : 0 - 1
¿ Qué es el “ruido
de cuantización”?
2. Conversores A-D
f. ADC - Sigma Delta
El error máximo de cuantización de un conversor
A/D ideal es de ±½ LSB
Considerando una distribución uniforme de la
probabilidad de error:
q
s 2s
q2 q
t s t dt RMS
2 2
q q 12 12
2s
q2N q2N
v t sin 2 f t vRMS
2 2 2
Señal auxiliar propuesta para el error
Siendo la relación señal/ruido cuantización:
POT (v ) vRMS 3
SNR 10 log10 20 log10 20 log10 2 N
20log 10
SNR 6.02 N 1.76dB
POT ( ) RMS 2
Potencia
• La ecuación del lazo resulta: Señal
1
Y X -Y Q
f Ruido de
cuantización
X Q f fs Kfs
fs Kfs
Y 2 2
f 1 f 1
Se reduce notablemente
el ruido de cuantización!!
f Y ≈ X (Q ≈0)
f Y ≈ Q (X ≈0)
2. Conversores A-D
f. ADC - Sigma Delta
• Aumentando el orden del modulador se
obtienen mejores SNR:
• Solución:
Existen dos alternativas:
Utilizar un Σ-Δ de tercer orden.
Esto implica un K de 26:
fs = 20kHz x 2 x 26 = 1.04MHz 26 85
Desventajas:
Limitación en la velocidad de conversión debido a la necesidad de sobremuestreo.
Problemas en sistemas multiplexados debido a la latencia del filtro digital:
- Sin embargo, en estos casos la solución más económica y conveniente es
colocar un circuito integrado con varios Sigma-Delta incorporados.
2. Conversores A-D
f. ADC - Sigma Delta (ejemplo)