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Curso: Sistemas Operativos Integrantes: - Contreras Ulloa, Shirley A. - Gonzales Torres, Cristian G. - Loyola Daz, Jhon A. - Valencia Varas, Karen A. - Villegas Snchez, Emili P. Ciclo: VI Seccin: A Trujillo Per 2010
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CPU
Memoria
Controlador de Video
Controlador de Teclado
BUS
Figura N2: Algunos de los componentes de un ordenador personal sencillo La interfaz entre el controlador y el dispositivo es a menudo una interfaz de muy bajo nivel.
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Por otra parte, el controlador de E/S realiza la Comunicacin con el dispositivo. Esta comunicacin comprende rdenes, informacin del estado del dispositivo y datos. Adems otra de sus tareas es el Almacenamiento con el
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Lnea de datos
Figura N3: Diagrama de Bloques de un controlador de E/S El controlador de E/S se conecta con el resto del computador a travs del bus del sistema. Los datos que se transfieren al controlador o desde el controlador se almacenan temporalmente en uno o ms registros de datos. Tambin puede haber ms de un registro de estado que proporcione la informacin del estado actual.
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Memoria
PE/S 1
PE/S n
Perifrico
Controlador de E/S
Controlador de E/S
Perifrico
Perifrico
Controlador Controlador de E/S de E/S Bus E/S Bus E/S PE/S 1 PE/S n Figura N4: Estructura de un sistema con PE/S
Perifrico
c. Acceso directo a Memoria: La CPU requiere transferir datos entre la memoria y un perifrico. La CPU puede solicitar datos del controlador de E/S byte a byte, pero hacindolo as estara desperdicindose mucho tiempo de CPU. Por ello se usa un esquema diferente denominado acceso directo a memoria (DMA). El SO solo puede usa DMA si el hardware cuenta con l, pero la mayora cuenta con l, aunque a veces est integrado en los controladores de disco o en otros controladores, pero tal diseo es tener un controlador DMA por cada dispositivo. El controlador de DMA tiene acceso al bus del sistema independientemente de la CPU. El controlador contiene varios registros (registro de direccin de memoria, un registro contador de bytes y uno o ms de registros de control) en los que la CPU pueden leer y escribir.
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Buffer Controlador de DMA Direccin Contador Control Controlador de Disco Memoria principal
CPU
Figura N5: Funcionamiento de una transferencia con DMA 1 Paso: La CPU programa el controlador DMA, escribiendo los valores apropiados en sus registros para que sepa qu debe transferir y a donde debe transferir. La CPU enva tambin un comando al controlador del disco para indicarle que lea los datos el disco en su bfer interno y compruebe el checksum. Cuando haya datos vlidos en el bfer del controlador del disco, el DMA puede comenzar. 2 Paso: El controlador de DMA inicia la transferencia enviando por el bus una peticin de lectura al controlador de disco. 3 Paso: La escritura en memoria es otro ciclo de bus estndar. 4 Paso: Cuando termina la escritura, el controlador del disco enva una seal de acuse al controlador de DMA, tambin por el bus. Transferencia de datos mediante DMA: El controlador de DMA necesita tener el control del bus para poder transferir datos hacia (o desde) la memoria. Existen diferentes formas de obtener el control del bus que suponen distintos compromisos entre velocidad de transferencia y actividad de la CPU. Por rfagas: Cuando el DMA toma control del bus no lo libera hasta haber transmitido el bloque de datos pedido. Con este mtodo se consigue la mayo velocidad de transferencia pero se tiene a la CPU inactiva durante periodos relativamente grandes. Tambin se conoce como para del procesador.
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Figura N6: DMA por rfagas Por robo de ciclos: Cuando el DMA toma el control del bus lo retiene durante un solo ciclo. Transmite una palabra y libera el bus. El proceso acaba cuando se ha transferido todo el bloque. Es la forma ms usual de transferencia y en ella el DMA roba ciclos a la CPU. El robo de ciclos reduce la velocidad de transferencia y la interferencia del controlador de DMA sobre la actividad de la CPU. El mtodo resulta de utilidad cuando se desea simultanear la ejecucin de un programa con la recepcin o transmisin de datos a velocidades moderadas. La CPU no tiene que ocuparse para nada de la operacin y sigue ejecutando su programa, casi con la misma velocidad, mientras que de forma simultnea se efecta la transferencia de d a t o s . Figura N7: DMA por robos de ciclos DMA transparente: Es posible eliminar completamente la interferencia entre el controlador de DMA y la CPU. Se consigue si se disea el DMA de forma que solamente se roban ciclos cuando la CPU no est utilizando el bus del sistema. La CPU no necesita usar el bus en todas las fases de la ejecucin de una instruccin. La ejecucin del programa de la CPU no disminuye su velocidad, pero concurrentemente tiene lugar una transferencia por DMA. Anlogamente el caso de robo de ciclos no se obtiene la ventaja de una velocidad de transferencia muy elevada propia del DMA.
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