Formulas y mas

TEMA 1

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 TEMA 2

Diferencia entre Algoritmo Tomasulo sin especulación y con especulación

CON ESPECULACION → Existe ROB - NO HAY STORE BUFFER

SIN ESPECULACION → No hay ROB - Hay BUFFER LOAD Y STORE

Segmentada vs NO Segmentada

Las UFs pueden ser Segmentada o no, afecta a WB.

Esto supone que si es segmentada, se puede proceder a 25, y otro 3

6, por ejemplo.

WRITE → ER ocupada

COMMIT → ROB ocupado

TEMA 4

ESTRUCTURA DE UN PROCESADOR VECTORIAL VMIPS

Vector LOAD/STORE = Es como un pipe, un dato por ciclo, despues de la

latencia inicial → 12

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 UFs Segmentada:

ADD = 6 etapas

MUL = 7etapas

DIV = 20

8 registros vectoriales

1 reg = 64 elementos

1 elemento = 64 bits

16 read; 8 write ports

Repertorio de instrucción VMIPS - CON EJEMPLOS.

LV/SV
LV V1, R1 → Cargamos de memoria en la pos R1 en el registro vectorial 1

SV R1, V1 → Guardamos en la posición R1 de memoria, el vector V1

Modos de direccionamiento especiales para vectores no contiguos

LVWS

Carga elementos equiespaciados a una cierta distancia

LOAD VECTOR WITH STRIDE

LVI

LOAD VECTOR using INDEX

El contenido de un registro vectorial indica las posiciones de los
elementos a cargar

Registros especiales de longitud vectorial VLR y máscara

Reg VLR

Indica la longitud de los vectores a procesar 64

Reg VM

Registro de 64 bits. Para las posiciones con VM a cero, la operación no

se ejecuta.

Ejecución selectiva de operaciones sobre componentes

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 LVWS → V1, R1, R2

Cargamos en V1, desde la dirección en R1 con stride en R2 (...R1+ixR2

DIVSV y SUBSV → Son las unicas operaciones de escalar (primero) y vector

luego. Los demas VV Y VS.

CVI V1, R1 → Crear un indice de vector para guardar los valores: 0, 1xR1, 2xR1,
... , 63xR1 en V1

S - VS V1, V2 EQ, NEQ, GT, GE, LT, LE

Si es true → 1's a la mascara del vector - VM

No he visto por ahora ejercicios de este tipo

POP R1, VM → Cuenta los 1s que hay en VM y lo guarda en R1

MTC1 VLR, V1 → Mueve el contenido de R1 a registro VL

MFC1 V1, VLR → Al reves que el anterior.

MVTM VM, F0 → Lo mismo que el anterior pero es F0

MVFM F0, VM → Lo mismo que MFC1

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 TEMA 5

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