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20966986
Diseño lógico
1) 45 – 101101(2)
2) 23 – 10111(2)
3) 2 – 10(2)
4) 16 – 10000(2)
5) 45 – 0100(2); 0101(2)
6) 23 – 0010(2); 0011(2)
7) 2 – 0010(2)
8) 16 – 0001(2); 0110(2)
9) 45
4 = 4 + 3 = 7 = 0111(2)
5 = 5 + 3 = 8 = 1000(2)
10) 23
2 = 2 + 3 = 5 = 0101(2)
3 = 3 + 3 = 6 = 0110(2)
11) 2
2 = 2 + 3 = 5 = 0101(2)
12) 16
1 = 1 + 3 = 4 = 0100(2)
6 = 6 + 3 = 9 = 1001(2)
13) 45
1 Bit = N/A
2 Bits = N/A
3 Bits = N/A
4 Bits = N/A
5 Bits = N/A
6 Bits = 101101
14) 23
1 Bit = N/A
2 Bits = N/A
3 Bits = N/A
4 Bits = N/A
5 Bits = 10111
6 Bits = 010111
15) 2
1 Bit = N/A
2 Bits = 10
3 Bits = 010
4 Bits = 0010
5 Bits = 00010
6 Bits = 000010
16) 16
1 Bit = N/A
2 Bits = N/A
3 Bits = N/A
4 Bits = N/A
5 Bits = 10000
6 Bits = 010000
e) Mostrar cómo se implementa un decodificador (solo para este ejercicio generar Diagrama, tabla
de verdad, expresión lógica)
f) Mostrar cómo se implementa un multiplexor (solo para este ejercicio generar Diagrama, tabla
de verdad, expresión lógica).
Conclusión
Referencias
Gómez A., Aldridge A. & Marius A.. (2018). Decodificadores y demultiplexores . 01/02/2021, de
Unican Sitio web: https://personales.unican.es/manzanom/Planantiguo/EDigital I/DecG3_10.pdf
Luque J.. (2016). Circuitos combinacionales-05. Codificadores. 13/02/2021, de FDT Sitio web:
https://www.youtube.com/watch?v=0bJxrDzAv0g