SEGUNDO EXAMEN PARCIAL DE SISTEMAS DIGITALES

CODIGO: FECHA: .
NOMBRE Y APELLIDO: MAX CUADROS GUTIERREZ

CODIGO: 19121035

1. Transformar la siguiente expresión suma de productos estándar en un mapa de Karnaugh:

𝑋 = (𝐴̅ + 𝐵̅ + 𝐶 + 𝐷)(𝐴̅ + 𝐵 + 𝐶̅ + 𝐷
̅ )(𝐴 + 𝐵 + 𝐶̅ + 𝐷)(𝐴̅ + 𝐵̅ + 𝐶̅ + 𝐷
̅ )(𝐴̅ + 𝐵 + 𝐶 + 𝐷
̅)

Y hallar su expresión reducida en suma de productos y productos de sumas, y graficar el circuito

Lógico óptimo
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2. Simplifique y dibuje sus circuitos
a. 𝑧 = 𝐴 𝐵 𝐶 + 𝐴 𝐵 𝐶 + 𝐴 𝐵 𝐶
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b. 𝑧 = (𝐶 + 𝐷) + 𝐴 𝐶 𝐷 + 𝐴 𝐵 𝐶 + 𝐴 𝐵 𝐶 𝐷 + 𝐴 𝐶 𝐷
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3. Simplificar La Expresión, grafique el circuito reducido y dibujar el diagrama de tiempos si:
𝑧 = [(𝐴 + 𝐵) + (𝐵 + 𝐶)] (𝐴 + 𝐵 + 𝐶)

z
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4.
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5. Realizar:
a. Elaborar la tabla de verdad.
b. REALIZAR EL MAPA DE KARNAUGTH Y HALLAR LA ESPECIÓN REDUCIDA.
c. DIBUJAR EL CIRCUITO.

Para el problema:

(Número menores que 6), (mayores de 11 y menores que 22), y (mayores que 28). (EN EL RANGO DE
números del 0 AL 31)
(Entradas de 6 Bits)

6. Determinar el código Hamming de paridad impar para los bits de datos 11001
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7. Corregir cualquier error que pueda haber en los siguientes códigos Hamming con paridad par:
a. 1110100
b. 1000111
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8. Determinar la señal de salida para las entradas indicadas en la Figura 3.85, y dibujar el diagrama de tiempos.
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9. Determinar cuáles de los circuitos lógicos de la Figura son equivalentes. (DESARROLLE Y JUSTIFIQUE)
a)

B)
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C)

D)
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10. Para la tabla de verdad de la Figura, obtener una expresión suma de productos (estándar y reducida) y
producto de sumas (estándar y reducida)