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I. OBJETIVOS
1. Comprobar el funcionamiento de los Flip-Flops en Maquinas de Estados Finitos.
2. Diseñar Máquinas de Estados Finitos.
3. Implementar circuitos secuenciales tanto en circuitos discretos como VHDL
II. CUESTIONARIO
1. Compruebe en la herramienta EDA Microcap 12, el funcionamiento de los siguientes
dispositivos de memoria: Latch SET; Latch RESET; Latch SET-RESET, construido con
puertas NOR; Latch SET-RESET, construido con puertas NAND. Latch S-R construido
con compuertas NOR y controlado por compuertas y Latch S-R construido con compuertas
NAND y controlado por compuertas.
Nota: Simular para todos los posibles valores de entrada que muestren de forma apropiada
las salidas esperadas.
Nota: Las simulaciones deben recorrer todas las posibles transiciones de la máquina de
estados.
3. Utilizando la herramienta EDA Quartus II, diseñe una máquina de estados que reconozca
la secuencia X= 0, 0, 1, 1, 0; con traslape, estableciendo un ‘1’ a la salida Z cuando se
reconozca el último ‘0’ de la secuencia, y ‘0’ en otro caso, con la mínima cantidad de
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estados. Según el siguiente procedimiento:
a) Implementar la FSM en VHDL tanto en Mealy como en Moore (sin entrada de
reset) y con una entrada de reloj ‘clk’ activado por flanco de subida.
b) Realizar todo el flujo de compilación del proyecto.
c) Realizar la simulación temporal.
Nota: Las simulaciones deben recorrer todas las posibles transiciones de la máquina de
estados.
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