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Multiplexor 4 a 1
schematic
VHDL de la simulación.
Multiplexor de 3-1
Esquemático
b. Un pantallazo del resultado (diagrama) de la simulación, en el cual se debe
VHDL de la simulación.
MULTIPLEXOR 8 A 1
Esquemático
VHDL de la simulación.
2. Describa en VDHL un decodificador de 3 entradas utilizando la
sentencia with-select.
El diseño debe contener:
Figura 1
Esquemático
b. Un pantallazo de la simulación, en el cual se debe evidenciar el
correcto funcionamiento del diseño.
6. Describa en VDHL el circuito que se muestra en la siguiente figura.
El diseño debe contener tres módulos diferentes (tres COMPONENTs)
y un archivo de alto nivel, tal como se muestra en la siguiente figura.
Figura 3
Multiplexor
b. Un pantallazo con el RTL del alto nivel.
Esquemático