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Unidad III
Por estar basadas en compuertas lógicas las entradas y salidas son niveles de
voltaje que representan los estados lógicos ¨1¨ ó ¨0¨. Por definición, las salidas
no influyen en el comportamiento del circuito combinacional porque si lo hace,
entonces el sistema completo es secuencial.
Se plantea el problema.
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1.2 SUMADORES
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Y el diagrama lógico:
Figura 2. ½ Sumador
La suma de dos dígitos genera un acarreo, el cual debe ser sumado con
los diodos de la etapa posterior. Sin embargo, al sumador anterior no es
capaz de sumar dos dígitos y un acarreo anterior. Por esta razón de debe
diseñar un circuito que sea capaz de superar esta situación. De esta
manera, la tabla de verdad se transforma a:
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Y el circuito es:
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Un full adder puede ser implementado con dos half adder y una
compuerta OR.
Figura 5. Implementación
1.4 RESTADORES
Tabla 2
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Figura 6. ½ Sustractor
Tabla 3
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Figura 8. Sustractor
1.6 CODIFICADORES
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Y el circuito es el siguiente:
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1.7 DECODIFICADORES
Decodificador 2 a 4.
Tabla 4
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Tabla 5
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Tabla 6
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Debido a que cada código usa cuatro bits para representar un digito
decimal deberá haber cuatro variables de entrada y cuatro variables de
salida.
Cabe hacer notar que para cuatro variables binarias es posible obtener 16
combianciones de las cuales solo 10 están listadas en la tabla de verdad.
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Y el circuito lógico.
1.9 COMPARADORES
Los posibles tipos de datos digitales que se puede comparar son Números
binarios, Números decimales representados en un código binario o
cualquier otro conjunto ordenado de elementos de información discretos.
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Tabla 7
Figura 17
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1.10 MULTIPLEXORES
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Usando multiplexores.
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Tabla 8
Tabla 9
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1.11 DEMULTIPLEXORES
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