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ACTIVIDAD N° 05
Docente
Ayacucho – Perú
Septiembre de 2020
SISTEMAS DIGITALES Y ARQUITECTURA DE COMPUTADORES
Actividad N° 05
Hora: 23:00
F1=A
2. Dibuje los siguientes circuitos lógicos, solo usando compuertas NAND, repita con solo
compuertas NOR, de las siguientes funciones:
a) F1(X, Y, Z) = (X'Y + XY')Z + Z'(XY + X'Y')
̅ ) ∗ (𝐵̅ + 𝐶̅ )
𝐹1 = (𝐴 + 𝐶 + 𝐷) ∗ (𝐵̅ + 𝐷
̅ ) ∗ (𝐵 + 𝐷
𝐹2 = (𝐶 + 𝐷 ̅ ) ∗ (𝐴 + 𝐵̅)
4. Utilizar mapa k para minimizar las siguientes funciones como “minterms” y como
“Maxterms”.
a) F1 = m (0,1, 4, 5, 9, 11, 15) + d (2, 6,7, 13)
Usando el mapa de k para desarrollar la función con “minterms”:
= (𝐴̅ ∗ 𝐶̅ ) + (𝐴 ∗ 𝐶) + (𝐵̅ ∗ 𝐶̅ )
= (𝐵̅) + (𝐴̅)
= 𝐴̅ + 𝐵̅
= (𝐵̅ ∗ 𝐷) + (𝐶̅ ∗ 𝐷
̅ ) + (𝐴 ∗ 𝐷
̅)
= (𝐴 + 𝐶̅ + 𝐷) ∗ (𝐵̅ ∗ 𝐷
̅)
5. Sea X1 X0 un numero binario de 2 bit que puede tener cualquier valor (00, 01, 10, 11; por
ejemplo, cuando X1 = 1 y X0 = 0, el numero binario es 10. De manera similar, Y1 Y0
representa otro número binario de 2 bit. Diseñe un circuito lógico utilizando las entradas
X1 X0 y Y1 Y0 y cuya salida sea ALTA solo cuando los dos números binarios sean iguales.
6. Un numero binario de 4 bit se representa como A3A2A1A0, donde A3, A2, A1 y A0 representan
los bits individuales con A0 igual a LSB. Diseñe un circuito lógico que produzca una salida
ALTA siempre que el número binario sea mayor que 0010 y menor que 1000.
Solución:
Tenemos que la salida es uno cuando:
A3A2A1A0=0011
A3A2A1A0=0100
A3A2A1A0=0101
A3A2A1A0=0110
A3A2A1A0=0111
En todas las demás situaciones la salida es cero
7. Un código BDC se trasmite a un receptor lejano. Los bits son A3, A2, A1 y A0 con A3 como el
MSB. El circuito receptor contiene un circuito detector de errores BDC que examina el código
recibido para ver si es un código BDC legal (es decir de 0 a 9 en decimal). Diseñe este circuito
para reproducir un nivel ALTO para cualquier condición de error.
N° A3 A2 A1 A0 SALIDA
0 0 0 0 0 0
1 0 0 0 1 0
2 0 0 1 0 0
3 0 0 1 1 0
4 0 1 0 0 0
5 0 1 0 1 0
6 0 1 1 0 0
7 0 1 1 1 0
8 1 0 0 0 0
9 1 0 0 1 0
10 1 0 1 0 1
11 1 0 1 1 1
12 1 1 0 0 1
13 1 1 0 1 1
14 1 1 1 0 1
15 1 1 1 1 1
(A2+A1)*(A3)
Observamos que la salida no depende del bit A0 esto se debe a que es el bit menos
significativo y no importa que valores tome. Pasamos a la simulación del circuito y
formamos la tabla de verdad:
Tabla de verdad:
N° A3 A2 A1 SALIDA
0 0 0 0 0
1 0 0 1 0
2 0 1 0 0
3 0 1 1 0
4 1 0 0 0
5 1 0 1 0
6 1 1 0 1
7 1 1 1 1
N° x y z Q
0 0 0 0 1
1 0 0 1 0
2 0 1 0 0
3 0 1 1 0
4 1 0 0 0
5 1 0 1 0
6 1 1 0 0
7 1 1 1 1
Según la tabla de verdad la salida será 1 solo cuando todas las entradas valgan 0 o
cuando todas valgan 1. El resto equivale a 0. De la tabla de verdad sacamos la
siguiente ecuación:
Q = ̅̅̅̅̅̅̅̅̅̅̅̅̅̅
(x + y + z) + (x ∗ y ∗ z)
Con esta ecuación se puede construir el circuito combinacional. El cual a simple vista
consta de una compuerta NOR de tres entradas, una AND de tres entradas y una OR de
dos entradas.
Solución
N° L I D X
0 0 0 0 0
1 0 0 0 0
2 0 0 1 0
3 0 0 1 1
4 0 1 0 1
5 0 1 0 1
6 0 1 1 0
7 0 1 1 1
(I*D)+(L*~I)
IMPLEMENTACION
10. Cuatro tanques de gran capacidad de una planta química contienen diferentes líquidos
sometidos a calentamiento. Se utilizan sensores de nivel de líquido para detectar si el nivel
de los tanques A y B excede un nivel predeterminado. Los sensores de temperatura de los
tanques C y D detectan cuando la temperatura de estos tanques desciende de un límite pre
escrito.
Suponga que las salidas A y B del sensor de nivel del líquido son BAJOS cuando el nivel
satisfactorio y ALTOS cuando es demasiado alto.
Asimismo, la salida C y D del sensor de temperatura son BAJAS cuando la temperatura es
satisfactoria y ALTAS cuando la temperatura es demasiado baja.
Diseñe el circuito lógico que detecte cuando el nivel del tanque A o B es muy alto al mismo
tiempo que la temperatura ya sea en el tanque C o en el D es muy baja.
N° A B C D N N° A B C D T
0 0 0 0 0 0 0 0 0 0 0 0
1 0 0 0 1 0 1 0 0 0 1 1 A’B’C’D
2 0 0 1 0 0 2 0 0 1 0 1 A’B’CD’
3 0 0 1 1 0 3 0 0 1 1 1 A’B’CD
4 0 1 0 0 1 A’BC’D’ 4 0 1 0 0 0
5 0 1 0 1 1 A’BC’D 5 0 1 0 1 1 A’BC’D
6 0 1 1 0 1 A’BCD’ 6 0 1 1 0 1 A’BCD’
7 0 1 1 1 1 A’BCD 7 0 1 1 1 1 A’BCD
8 1 0 0 0 1 AB’C’D’ 8 1 0 0 0 0
9 1 0 0 1 1 AB’C’D 9 1 0 0 1 1 AB’C’D
10 1 0 1 0 1 AB’CD’ 10 1 0 1 0 1 AB’CD’
11 1 0 1 1 1 AB’CD 11 1 0 1 1 1 AB’CD
12 1 1 0 0 1 ABC’D’ 12 1 1 0 0 0
13 1 1 0 1 1 ABC’D 13 1 1 0 1 1 ABC’D
14 1 1 1 0 1 ABCD’ 14 1 1 1 0 1 ABCD’
15 1 1 1 1 1 ABCD 15 1 1 1 1 1 ABCD
Las entradas se dividirán para representar filas y columnas, de esta forma se podrá
posicionar la salida a su lugar correspondiente.
El número de salida es igual a el numero de mapas de Karnaugh que se tendrán que crear.
En este caso se tienen dos salidas por lo que se crearan solo dos mapas
N=(B)+(A)
T=(D)+(C)
DIAGRAMA
El diagrama lógico de las salidas “N” y “T” utilizan una compuertas OR, ya que esta
compuerta representa una suma.
=(B*D)+(B*C)+(A*D)+(A*C)
IMPLEMENTACION EN TINKERCAD
Indicaciones: