LABORATORIO ELÉCTRONICA DIGITAL

Practica 8: Latch, Flip Flop y Temporizador 555

LABORATORIO #2-2
Juan Pablo Torres Contreras, U00121921
Catalina Aparicio Niño, U00122414
LATCH, FLIP FLOP Y TEMPORIZADOR 555

INTRODUCCIÓN
Esta práctica recoge los fundamentos de la
lógica secuencial, donde se tocarán los
dispositivos biestables: los cuales se dividen
en los flip-flops y los latches. Sus dos estados
estables son los llamados SET (activación) y
RESET (desactivación) en los que se pueden
mantener indefinidamente, lo que les hace
muy útiles como dispositivos de
almacenamiento. Figure 1.Latch S-R (SET-RESET)

Un latch es un tipo de dispositivo lógico

OBJETIVOS
 Obtener y revisar las tablas de verdad
de Latch y Flip-Flop RS y D
 Analizar el funcionamiento de un Flip
Flop y Latch su uso en diferentes
configuraciones
 Analizar el funcionamiento del
temporizador 555 como multivibrador
monoestable o como multivibrador
aestable.
ESTADO DEL ARTE
Latches
El latch (cerrojo) es un tipo de dispositivo de
almacenamiento temporal de dos estados
(biestable), que se suele agrupar en una
categoría diferente a la de los flip-flops.
biestable o multivibrador. Un latch S-R (Set-
Reset) con entrada activa a nivel ALTO se
compone de dos compuertas NOR acopladas,
tal como se muestra en la Figura (1).
Flip-Flop
Los flip-flops son dispositivos síncronos de
dos estados, también conocidos como
multivibradores biestables. En este caso, el
término síncrono significa que la salida
cambia de estado únicamente en un instante
específico de una entrada de disparo
denominada reloj (CLK), la cual recibe el
nombre de entrada de control, C. Esto significa
que los cambios en la salida se producen
sincronizadamente con el reloj.

Básicamente, los latches son similares a los

flip-flops, ya que son también dispositivos de
dos estados que pueden permanecer en
cualquiera
de sus dos estados gracias a su capacidad de
realimentación, lo que consiste en conectar
(realimentar) cada una de las salidas a la
entrada opuesta. La diferencia principal entre
ambos tipos de dispositivos está en el método Figure 2.FLIP-FLOPS DISPARADOS POR
FLANCO
empleado para cambiar de estado.
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Aplicaciones de los flip-flops.
 Almacenamiento de datos paralelo.
Uno de los requisitos más comunes de los
sistemas digitales consiste en almacenar
de forma simultánea una serie de bits de
datos, procedentes de varias líneas
paralelas, en un grupo de flip-flops. Este
proceso se ilustra en la Figura (a),
utilizando cuatro flip-flops. Cada una de
las cuatro líneas paralelas de datos se
conecta a la entrada D de un flip-flop. Las
entradas de reloj de los flip-flops se
conectan juntas, de forma que los flip-
flops son disparados mediante el mismo
impulso del reloj. En este ejemplo, se
utilizan flip-flops disparados por flanco
positivo, por lo que los datos de las
entradas D se almacenan simultáneamente
en los flip-flops con el flanco positivo de
reloj, como se indica en el diagrama de
tiempos de la Figura (b). Además, las
entradas de puesta a cero asíncronas (R) se
conectan a una línea común, que
inicialmente pone a cero a todos los flip-
flops.
Figure 3.Grupo de flips-flops para almacenamiento
 División de frecuencia.
Otra de las aplicaciones de un flip-flop
es la división (reducción) de
frecuencia de una señal periódica.
Cuando se aplica un tren de impulsos
a la entrada de reloj de un flip-flop J-K
conectado en modo de basculación (J
= K = 1), la salida Q es una señal
cuadrada que tiene una frecuencia
igual a la mitad de la que tiene la señal
de reloj. Por tanto, se puede utilizar un
único flip-flop como un divisor por 2,
como muestra la Figura 7.37. Como
puede verse, el flip-flop cambia de
estado en cada flanco de disparo del
impulso de reloj (flancos positivos en
este caso). Esto da lugar a una salida
que varía a la frecuencia mitad de la
señal de reloj.
Figure 4.Flip-Flop como un divisor por 2
(frecuencia)
 Contadores.
Otra de las aplicaciones importantes
de los flip-flops son los contadores
digitales. El concepto se ilustra en la
Figura siguiente. Los flip-flops son de
tipo J-K disparados por flanco
negativo. Ambos flip-flops se
encuentran inicialmente en estado
RESET. El flip-flop A bascula en las
transiciones negativas de cada impulso
de reloj. La salida Q del flip-flop A
dispara el flip-flop B, de manera que
siempre que QA realiza una transición
de nivel ALTO a nivel BAJO, el flip-
flop B bascula. Las señales resultantes
QA y QB se muestran en la figura.
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Figure 7.Terminales en el circuito integrado.

DESARROLLO DE LA PRACTICA

1. Latch
Figure 5.Flips-Flops como contadores digitales.
a. Implementar un circuito que
permita verificar la tabla de
Temporizador 555 verdad del Latch R-S usando la
configuración básica.
El temporizador 555 es un circuito integrado
de 8 terminales que se utiliza para la
generación de intervalos de tiempo. A pesar de
que se utiliza principalmente como
temporizador para activar o desactivar algún
circuito o componente electrónico, también lo
podemos utilizar como generador de pulsos,
multivibrador, alarma, interruptor digital, entre
otras aplicaciones más específicas.
Figure 8.Tabla de verdad.

Simulación:

b. Implementar un circuito que

permita verificar la tabla de
Figure 6. Circuito Integrado del temporizador 555 verdad del Latch D usando la
configuración básica.
 Terminales del temporizador

Figure 9.Tabla de verdad

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Simulación: Figure 11.Señal de salida Q

c. Implementar circuitos que permita

Simulación:
verificar Utilizar los circuitos
integrados 74LS279 y 74LS75
para obtener los diagramas de
tiempo utilizando entradas tipo
pulso de reloj. Obtenga la señal de
3. Temporizador 555
salida con un osciloscopio
a. Verificar el funcionamiento del
temporizador 555 como
2. Flip-Flop
multivibrador monoestable,
usando la siguiente configuración.
a. Implementar un circuito que
Utilizar un led de salida y obtener
permita verificar la tabla de
la señal con el osciloscopio.
verdad del Flip-flop S-R disparado
 Realice pruebas para varios valores de
por flanco de un impulso de reloj
R1 y C1.
usando la configuración básica
 Determine valores de R1 y C1 para
que la anchura del pulso sea de 30 ms
𝑡𝑊 = 1,1𝑅1𝐶1

Figure 10.Tabla de verdad

Simulación:

Figure 12.Terminales en el temporizador para

simulación

Simulación:
b. Utilizando un Flip Flop JK,
implemente un circuito en proteus b. Verificar el funcionamiento del
que permita verificar los temporizador 555 como
diagramas de tiempo que se multivibrador aestable, usando la
muestran a continuación. Utilice siguiente configuración. Utilizar
un osciloscopio para verificar la un led de salida y obtener la señal
señal de salida Q con el osciloscopio.
 Realice pruebas para varios valores de
R1, R2 y C1, para valores diferentes
de 𝑡𝐻 y 𝑡𝐿.
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 Determine
valores de R1, R2 y C1 para que

Figure 13.Terminales en el
temporizador para simulación
período T, sea de 30 ms.
𝑡𝐻 = 0,7(𝑅1 +𝑅2)𝐶1
𝑡𝐿 = 0,7𝑅2𝐶1
𝑇 = 𝑡𝐻 +𝑡𝐿 = 0,7(𝑅1 +𝑅2)𝐶1+0,7𝑅2𝐶1

Simulación:

REFERENCIAS
 Carrod eléctronica. (n.d.). Carrod eléctronica. From Carrod eléctronica:
https://www.carrod.mx/products/ci-ttl-decodificador-y-controlador-bcd-a-siete-segmentos-
con-salidas-de
 Circuitos Digitales . (2015, Noviembre 14). Circuitos Digitales . From Circuitos Digitales :
https://yoscarlenovo.wixsite.com/circuitos-digitales/single-post/2015/11/14/LATCHES-
FLIPFLOPS-Y-TEMPORIZADORES
 Dualtronica. (2020). Dualtronica. From Dualtronica: https://dualtronica.com/circuitos-
integrados/160-decodificador-demultiplexor-74ls138.html
 Floyd, T. L. (2006). Fundamentos de sistemas digtales . Madrid : PEARSON EDUCACIÓN
S.A.
 Ingeniería Mecafenix. (2017, Marzo 25). Ingeniería Mecafenix. From Ingeniería Mecafenix:
https://www.ingmecafenix.com/electronica/temporizador-555/
 Wikipedia. (2020, marzo 5). Wikipedia. From https://es.wikipedia.org/wiki/Multiplexor
 Wikipedia. (n.d.). Wikipedia. From Wikipedia: https://es.wikipedia.org/wiki/Demultiplexor