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Lab3 Digital 2020 1
Lab3 Digital 2020 1
Mayo 16 2020
2) (10 %) Debido a que las tarjetas programables poseen relojes con frecuen-
cias en el orden de MHz o GHz, es necesario hacer la implementación de un
divisor de frecuencia para lograr visualizar la respuesta que tienen algunos sis-
temas. Con esto mente, implemente en Quartus un divisor de frecuencia que
convierta el reloj de la FPGA usada en el curso (Buscar en la hoja de especifi-
caciones) a 1 segundo.
1. Realizar un diseño a mano del sistema haciendo uso de los distintos cir-
cuitos combinacionales aprendidos en el curso.
2. Implementar en Quartus el diseño realizado.
2. Decodificadores de 2 a 4.
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Adicionalmente realice una simulación en Quartus de su solución.