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UNIVERSIDAD TCNICA DEL NORTE

FACULTAD DE INGENIERAS EN CIENCIAS APLICADAS


CARRERA DE INGENIERA EN ELECTRNICA Y REDES DE COMUNICACIN
SISTEMAS DIGITALES
DOCENTE: ING. OMAR OA
QUINTO SEMESTRE
Nombres:

Marcelo Ibujs.
Eduardo Picuasi.
Paola Gmez.

Circuitos Integrados 74155 74154

Circuito integrado 74154

El 74155 es un CI que se puede usar como dos decodificadores de 2 a 4 o bien como dos
demultiplexores de 1 a 4 o como un decodificador de 3 a 8 o un demultiplexor de 1 a 8. ya que
como se sabe un demultiplexor se convierte en un decodificador al conectar su entrada a un
estado lgico fijo. Es uno de los ms usados de los CI de la familia TTL.

DEMULTIPLEXOR 1:4 CON PUERTAS LGICAS:

Para poder seleccionar entre 4 canales de salidas se necesita 2 entradas de seleccin. El


sistema tiene tres entradas:

E = dato.
E1 y E2 = variables lgicas de seleccin

Las salidas del sistema son cuatro:

S1 = salida del canal 1.


S2 = salida del canal 2.
S3 = salida del canal 3.
S4 = salida del canal 4.
Por convencin la entrada de enable es casi siempre negada, es decir las salidas estn
habilitadas siempre que la entrada enable sea 0.

La tabla de verdad del sistema es:

El circuito lgico con puertas lgicas es:

Se puede deducir que cada una de las salidas de las compuertas AND corresponde a cada uno
de los minterms posibles para funciones de dos variables, en este caso representadas por las
entradas

DECODIFICADOR 2 A 4
Un decodificador de 3 lneas a 8 lneas. Al igual que antes, cada salida representa un minterm,
en este caso, cada uno de los minterms posibles para funciones de tres variables.
Decodificador de Binario a Octal.

Circuito integrado 74154

Este circuito integrado contiene un demultiplexor 1:16, que tambin puede funcionar como
decodificadores 4 a 16.

DESCRIPCION

Este componente es capaz de decodificar 5 entradas proporcionando 16 distintas


salidas. Est compuesto de dos decodificadores octales unidos en Paralelo.

FUNCIONAMIENTO

Este componente se ha basado en el funcionamiento del componente TTL 74154. A su


vez este est realizado con dos decodificadores de 2 bits. Para que el circuito tenga un
buen funcionamiento, este tiene que tener activo a nivel bajo las dos habilitaciones
ESQUEMA INTERNO
Tabla de la verdad

La relacin de pines de este integrado es la siguiente:

A, B, C y D: entradas de seleccin activas a nivel alto (5V).

G1 y G2: entradas de validacin o datos activas a nivel bajo (0V).

Y0, Y1, Y2, Y3, Y4, Y5, Y6, Y7, Y8, Y9, Y10, Y11, Y12, Y13, Y14, Y15: salidas del
demultiplexor activas a nivel bajo (0V).
Bibliografa

Angulo Usategui, J., Hernndez Martn, J. C., Prieto Blanco, M. ., Etxebarra Isuskiza, M., &
Angolo Martnez , I. (2010). Electrnica Digital y Microprogramable. Madrid:
PARANINFO. Pgs 53-78

Floyd, T. (2006). Fundamentos de Sistemas Digitales. Madrid: PRENTICE HALL. Pgs 348-377

Viejo, C. B. (2005). Fundamentos de Electrnica Digital. Madrid: THOMSOM. Pgs 101

Web Links

http://meteo.ieec.uned.es/www_Usumeteog/comp_comb_demultiplexores.html#74155

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