PONTIFICIA UNIVERSIDAD CATLICA DEL PER

ESTUDIOS GENERALES CIENCIAS

2017-1

LABORATORIO DE DISEO DIGITAL

SESIN NMERO: 7 SEMESTRE: 2017-1

TEMA: CIRCUITOS SECUENCIALES II

DESCRIPCIN:

Esta gua corresponde a la cuarta sesin dirigida del laboratorio de Diseo Digital. Se
evaluarn conceptos de circuitos secuenciales avanzados.

OBJETIVOS:

Realizar un circuito secuencial detector de secuencia.

Conocer el funcionamiento de un controlador digital de video (VGA)
Realizar un controlador de video VGA.
Implementar circuitos digitales secuenciales en un FPGA.
Verificacin de funcionamiento de los circuitos diseados.

ACTIVIDADES A REALIZAR
DURACIN
N DESCRIPCIN PUNTOS
APROXIMADA

1 Experiencia 1: Detector de secuencia 0.0 Pts

2 Experiencia 2: Controlador VGA 0.0 Pts

3 Prueba de Salida 15 min. 5.0 Pts

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Experiencia N1:

Realice el circuito correspondiente al detector de la secuencia 1011 con traslape en versin Moore.

LIBRARY ieee ;
USE ieee.std_logic_1164.all ;

ENTITY dec1011 IS
PORT ( Clock, Resetn, w : IN STD_LOGIC ;
z : OUT STD_LOGIC ) ;
END dec1011 ;

ARCHITECTURE Behavior OF dec1011 IS

TYPE State_type IS (A, B, C, D, E) ;
SIGNAL y : State_type ;
BEGIN
PROCESS ( Resetn, Clock )
BEGIN
IF Resetn = '0' THEN
y <= A ;
ELSIF (Clock'EVENT AND Clock = '1') THEN
CASE y IS
WHEN A =>
IF w = '0' THEN
y <= A ;
ELSE
y <= B ;
END IF ;
WHEN B =>
IF w = '0' THEN
y <= C ;
ELSE
y <= B ;
END IF ;
WHEN C =>
IF w = '0' THEN
y <= A ;
ELSE
y <= D ;
END IF ;
WHEN D =>
IF w = '0' THEN
y <= C ;
ELSE
y <= E ;
END IF ;
WHEN E =>
IF w = '0' THEN
y <= C ;
ELSE
y <= B ;
END IF ;
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END CASE ;
END IF ;
END PROCESS ;

z <= '1' WHEN y = E ELSE '0' ;

END Behavior ;

Procedimiento:

Ruta a utilizar: C:\temp\1IEE04\H44XX\LAB7\CKTO1\, donde X se reemplaza segn su horario.

Dibujar el diagrama de estados.

Crear un nuevo proyecto en la ruta indicada, usando la descripcin VHDL mostrada.
Realizar la simulacin del circuito.
Realizar la programacin del dispositivo y comprobar los resultados. Use un pulsador como reloj del
sistema, un interruptor para reset y un interruptor para la entrada serial.

Utilice este espacio para implementar la solucin de la experiencia N1

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Experiencia N2:

Controlador VGA.
Realizar el circuito que genere las seales requeridas para controlar un monitor VGA. El controlador debe
generar las seales de sincronismo horizontal y vertical y a la vez emitir las seales de lo que debe proyectarse
en la pantalla. Las seales de sincronismo horizontal y vertical deben cumplir con las especificaciones que
se muestran en la figura 1.

Figura 1

Durante la emisin de la seal de sincronismo horizontal se dibuja en la pantalla 640 pxeles y deber
repetirse tantas veces como lneas horizontales deben dibujarse en la pantalla (480). La seal de sincronismo
vertical se repite cada 60Hz, de tal manera que la pantalla se refresca a dicha tasa.
Por otro lado, se deben generar las seales que proporcionarn los valores para los pixeles durante el tiempo
que demora cada lnea en dibujarse (Video Line en la figura). Dichas seales son tres que constituyen los
colores bsicos rojo, verde y azul, para lo cual se tendrn vectores de 4 bits para cada uno.
Para el formato VGA de 640 x 480 pxeles a 60Hz se usar el diagrama esquemtico mostrado en la figura
2.

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Figura 2.

La seal de video ser generada por el siguiente circuito, donde R, G y B son entradas de un bit cada uno y
que se conectarn a los interruptores.

Figura 3.

Procedimiento:

Ruta a utilizar: C:\temp\1IEE04\H44XX\LAB7\CKTO2\, donde X se reemplaza segn su horario.

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Verificar que se cumplan los tiempos requeridos detallados en la figura 1 en el circuito de la figura
2.
Deduzca que es lo que se dibuja en la pantalla segn el circuito de la figura 3.
Crear un nuevo proyecto en la ruta indicada.
Realice la descripcin VHDL de los circuitos.
Realizar la simulacin del circuito e interpretar los resultados obtenidos.
Realizar la programacin del dispositivo y comprobar los resultados.

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