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Grado: 5
Grupo: A
Materia:
Lenguajes de Interfaz
Profesor:
Jos Martin Villalobos
Procesadores
Modo protegido
Paginacin
Es una estrategia de organizacin de la memoria que consiste en dividir la
memoria en porciones de igual tamao, a dichas porciones se las conoce como
marcos de pgina o simplemente como pginas. Las pginas estn definidas por
un nmero de pgina, que identifica de forma nica a cada pgina (dentro del
espacio de memoria de un proceso). Cada pgina se asigna en exclusividad a un
proceso
La memoria virtual
El espacio de direcciones virtuales es el espacio de direcciones mximo
disponible para una aplicacin, vara de acuerdo a la arquitectura del sistema y del
sistema operativo. Este depende de la arquitectura puesto que es la arquitectura la
que define cuntos bits estn disponibles para propsitos de direccionamiento y
tambin depende del sistema operativo puesto que la forma en que el sistema
operativo fue implementado puede introducir lmites adicionales sobre aquellos
impuestos por la arquitectura.
La palabra "virtual" en el espacio de direcciones virtuales, significa que este
es el nmero total de ubicaciones de memoria direccionables disponibles para una
aplicacin, pero no la cantidad de memoria fsica instalada en el sistema, o
dedicada a la aplicacin en un momento dado.
Para implementar la memoria virtual, para el sistema es necesario tener un
hardware especial de administracin de memoria. Este hardware a menudo se
conoce como un MMU(Memory Management Unit). Sin un MMU, cuando el CPU
accede a la RAM, las ubicaciones reales de RAM nunca cambian la direccin
de memoria 123 siempre ser la misma direccin fsica dentro de la RAM.
Sin embargo, con un MMU, las direcciones de memoria pasan a travs de un
paso de traduccin antes de cada acceso de memoria. Esto significa que la
direccin de memoria 123 puede ser redirigida a la direccin fsica 82043 en un
momento dado y a la direccin 20468 en otro. Como resultado de esto, la
sobrecarga relacionada con el seguimiento de las traducciones de memoria virtual
a fsica sera demasiado. En vez de esto, la MMU divide la RAM en pginas
Fallos de pgina
Un fallo de pgina es la secuencia de eventos que ocurren cuando un
programa intenta acceder a datos (o cdigo) que est en su espacio de
direcciones, pero que no est actualmente ubicado en la RAM del sistema. El
sistema operativo debe manejar los fallos de pgina haciendo residentes en
memoria los datos accedidos, permitiendo de esta manera que el programa
contine la operacin como que si el fallo de pgina nunca ocurri.
Pipeline
Un pipeline o tubera es un conjunto de elementos procesadores de datos
conectados en serie, en donde la salida de un elemento es la entrada del
siguiente. Los elementos del pipeline son generalmente ejecutados en paralelo, en
esos casos, debe haber un almacenamiento tipo buffer insertado entre elementos.
Instrucciones MMX
Las instrucciones normales de un procesador son del tipo SISD, acrnimo
de Single Instruction Simple Data, es decir, con una instruccin realizamos una
tarea sobre un dato simple en un determinado momento. Estas fueron el tipo de
instrucciones que dominaron los procesadores para PCs durante muchos aos.
Se trata de instrucciones SIMD, Single Instruccion Multiple Data. Estas, son
capaces de realizar operaciones sobre varios datos. Por ejemplo puedes sumar,
restar o multiplicar varios datos en el tiempo que antes slo podas sumar dos. De
esta forma puedes aumentar radicalmente la ejecucin de ciertas tareas que usan
muchos datos.
Fueron las primeras instrucciones SIMD que se incluan en un PC. Se
aaden registros muy grandes donde se guarda la informacin para ser tratada.
En este caso se usan 8 registros de 64 bits. En realidad lo que se hace es
utilizar los registros de la unidad de ejecucin de punto flotante con lo cual no
puedes usarlos a la vez. Esta unidad de ejecucin es la encargada de calcular
cualquier operacin sobre nmeros reales que realices en tu equipo. Esto era una
de sus mayores problemas. Adems, slo permita operaciones con nmeros
enteros, lo cual limitaba mucho su aplicacin.
Podas, por ejemplo, sumar 8 enteros de 8 bits en una sola instruccin.