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LABORATORIO #2:
Respuesta en Frecuencia
Presentado por:
Vsquez Lpez, Nstor Gabriel
VL10008
ZL09002
RESUMEN
La respuesta en frecuencia de un amplificador se presenta en forma de un grfico que
muestra amplitud de salida (o, ms frecuentemente, la ganancia de tensin) en funcin
frente a la frecuencia. La representacin tpica de la ganancia de voltaje de un amplificador
funcin de la frecuencia se muestra en la figura 1. La ganancia es nula en frecuencia cero,
luego aumenta a medida que aumenta la frecuencia, el nivel de nuevos aumentos de la
frecuencia, y luego comienza a disminuir de nuevo a altas frecuencias. La respuesta en
frecuencia en los amplificadores establece el rango en el cual trabajar el sistema sin
distorsionar la seal. Este se conoce como ancho de banda (BW, Band Width) y determina
las frecuencias para las cuales se produce el proceso de amplificacin. El valor de este
parmetro depende de los dispositivos y de la configuracin amplificadora.
INTRODUCCIN
La respuesta en frecuencia es un parmetro que describe la forma en que un circuito se
comporta dependiendo de la frecuencia de la seal de entrada o la frecuencia a la cual
trabaja. La importancia de este tema nos obliga a entrar de lleno en ello utilizando todos los
conocimientos adquiridos anteriormente para resolver de diferentes formas la respuesta en
frecuencia de las configuraciones ms comunes de amplificadores con MOSFET y BJT.
El presente trabajo consiste en una sntesis de los resultados obtenidos sobre la
investigacin sobre la respuesta en frecuencia, tanto alta como baja, de las configuraciones
emisor comn con resistencias de degeneracin y un amplificador cascodo.
La metodologa consisti en investigar y estudiar el funcionamiento y las caractersticas en
frecuencia de las configuraciones mencionadas anteriormente as como tambin sobre los
mtodos de medicin de la respuesta en frecuencia en laboratorio. Luego de hacer el
anlisis terico y la simulacin se procedi a implementar los circuitos en el laboratorio
para comparar y analizar los resultados.
Para el anlisis terico de la respuesta en frecuencia de todas las configuraciones
anteriormente mencionadas se realizaron en papel, un anlisis por simulacin por
computadora, la cual revela resultados ms cercanos a la prctica. Una vez recopilada la
informacin se compararon los datos tericos y de simulacin para poder llevarlos a la
prctica.
DESARROLLO DE LA PRCTICA
Lista de materiales
Figura 1
= 10
= 225
A partir de la hoja de datos tenemos:
= 8;
= 196;
= 22.5
Figura 2
Mediciones Realizadas.
Para probar cada uno de los circuitos se inyect por medio del generador de seales una
onda senoidal con amplitud de 10mV para poder cumplir con el correcto funcionamiento a
pequea seal del transistor.
A continuacin se presentan los resultados del circuito de la figura 1.
Figura 3
Figura 4
Figura 5
Figura 6
Figura 7
Figura 8
Discusin.
Ambos circuitos tienen el funcionamiento esperado en base a los clculos para los
capacitores utilizados en la implementacin del circuito.
Para calcular los capacitores C1, C2 y C3 en el circuito de la figura 1, es necesario
determinar el valor de la resistencia que ve cada uno de ellos. Las cuales calculamos a
partir de las siguientes ecuaciones:
1 = +
2 = + ||
= 2 ||
+
+1
+
585 + 50
= 1.3// (
) = 2.804
+1
226
Con esto podemos calcular cada uno de los capacitores para una frecuencia de corte a
100Hz como se desea, debemos recordar que la resistencia de menor valor determina el
polo dominante en el que deseamos la frecuencia de corte, los dems se calculan de tal
forma que sus polos estn alejados del dominante.
3 =
1
1
=
= 567.6 560
2 2(2.804)(100)
1 =
10
10
=
= 25.06 22
21 2(635)(100)
2 =
20
20
=
= 31.55 33
22 2(1009)(100)
759.8
= 76
10
ste es el resultado en base a las mediciones realizadas, mientras que el valor terico est
dado por la siguiente ecuacin:
= ( || )( || || )/( + || )
= 89
Figura 9
Para e circuito de la figura 2, como se mencion antes, solo debe recalcularse C3 debido a
la influencia de la resistencia de 24 sobre la resistencia vista sobre dicho capacitor. La
nueva ecuacin para RCE es la siguiente:
=
1
1
(1 ||2 )
1
( + 1)1
1 (1 + (
))
+ ||
1
= 60.59 60.7
2(26.27)(100)
90.54
= 9.1
10
||
=
( + + || )( || + + )
Figura 10
Circuito Cascodo
Es importante recalcar que las ecuaciones utilizadas para la obtencin de los capacitores de
acoplo y desacoplo son en las que ya estn deducidas en Sedra.
Diagrama de fase:
= 69.24
= 12.1
Ahora probamos nuestro circuito con una seal senoidal de entrada de 1mV de amplitud
con frecuencia de 10kHz de modo que estamos en nuestra banda media:
Como podemos ver tenemos a la salida una seal de 67.68mV de amplitud lo cual se acerca
mucho a lo que esperbamos.
Ahora probamos con una seal de 69.24Hz de frecuencia:
Como podemos ver tenemos a la salida una seal senoidal de 48mV de amplitud y
deberamos tener:
67.42
2
= 47.86
De este modo demostramos que las mediciones son muy cercanas a lo que estimamos para
baja frecuencia.
Ahora probamos con una seal de 12.1MHz de frecuencia:
Como podemos ver tenemos una seal de salida de 47.84mV a la salida con lo cual
comprobamos nuestros resultados para alta frecuencia.
Podemos notar que el circuito cascodo tiene un ancho de banda muy grande y mantiene la
ganancia obtenida en el circuito emisor comn sin resistencia de degradacin lo cual resulta
muy conveniente.
Conclusiones
BIBLIOGRAFA
http://www.jameco.com/
Sedra y Smith. Circuitos Microelectrnicos, 5a Edicin. McGraw-Hill Interamericana
2006.
http://es.wikipedia.org/