UNIVERSIDAD NACIONAL DEL CALLAO

FACULTAD DE INGENIERA ELCTRICA Y ELECTRNICA

ESCUELA PROFESIONAL DE INGENIERIA ELECTRONICA

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SILABO
1.

INFORMACIN GENERAL
Asignatura
Numero de asignatura
Cdigo
Carcter
Pre-requisito
Crditos
Horas teora
Horas practica
Horas laboratorio
Tipo de evaluacin
Semestre acadmico
Duracin
Profesor

2.

SISTEMAS DIGITALES
19
LA0429
Obligatorio
Circuitos Digitales
04
03H
00H
03H
4
2013-B
17 SEMANAS
Ing. Daro Utrilla Salazar

SUMILLA
La asignatura de Sistemas Digitales, es de naturaleza, terica, prctica y experimental tiene el propsito
de brindar al alumno los conocimientos de la logica secuencial sincrona y asncrona. Anlisis de Diseo
de la maquina e estados Mealy y Moore. Memorias Semiconductoras RAM, ROM. . Lenguaje de
programacin VHDL. Sistema jerrquico de memorias. Introduccin al uso de Lenguajes de Descripcin
de Hardware. Uso del VHDL para modelamiento de sistemas digitales.

3.

OBJETIVOS GENERALES Y ESPECFICOS

1.

Anlisis y desarrollo de las mquinas de estados, con su conjunto de instrucciones, registros, memoria,
dispositivos, un ensamblador que genere secuencias programables y el simulador que muestre la
ejecucin de las mquinas de estados.
Sntesis de un dispositivo FPGA de un computador usando el VHDL como lenguaje de descripcin de
hardware.

2.

4.

METODOLOGA

(a) Las clases sern tericas, desarrollndose los temas segn el programa analtico. El profesor propiciara y
motivara a los alumnos a participar en clase.
(b) El alumno estudiara y repasara los temas que el profesor desarrolle. Esto permitir una mejor
participacin del alumno en clase.
(c) Se brindar asesora a los alumnos para las dificultades que el alumno encuentre en ciertos temas del
curso.
(d) Se dar separatas del curso.
(e) Se dar el silabo del curso.
(f) Las prcticas de laboratorio son de naturaleza obligatoria y el tema a desarrollar estar enmarcado
dentro del programa analtico.
5.

CRITERIOS DE EVALUACIN

La evaluacin del alumno se realizara con el tipo 4, la cual se indica por la frmula: PF = (PP+PL+EP+2EF)/5

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PP = promedio de prcticas calificadas
PL = promedio de laboratorios
EP = examen parcial
EF = examen final
PF = promedio final del curso
NOTA:
a) El alumno podr rendir un examen sustitutorio, el que ser nico y abarcar toda la asignatura, cuya
nota reemplazar a la nota ms baja del examen parcial o examen final.
b) La Nota Mnima Aprobatoria de la asignatura es 11.
6.

CONTENIDO ANALTICO SEMANAL

SEMANA N01: INTRODUCCIN
Organizacin y arquitectura. Estructura y funcin. Historia de los sistemas de lgica cableada
secuenciales, ventajas desventajas.
SEMANA N 02: SISTEMAS SECUENCIALES
Caractersticas. Tipos de circuitos sncronos y asncronos.
SEMANA N 03: ESTRUCTURA Y FUNCIONAMIENTO DE AS MAQUINAS DE ESTADOS
Estructura de las Maquinas de Estados Mealy y Moore. Organizacin de la Maquina de estados.
SEMANA N 04: DISEO DE SISTEMAS SECUENCIALES CON MAQUINA DE ESTADOS MEALY
Caractersticas, estructura, anlisis, diseo de sistemas secuenciales con FSM Mealy.
SEMANA N 05: DISEO DE SISTEMAS SECUENCIALES CON MAQUINA DE ESTADOS MOORE
Caractersticas, estructura, anlisis, diseo de sistemas secuenciales con FSM Moore
SEMANA N 06: PRACTICA CALIFICADA
SEMANA N 07: MEMORIAS SEMICONDUCTORAS
Conceptos bsicos de memorias Semiconductoras- Tipos de Memorias : RAM y ROM. Memoria principal.
Memoria Cach. Organizacin de memorias. Discos magnticos. Memoria Virtual. Dispositivos externos.
SEMANA N 08: EXAMEN PARCIAL
SEMANA N 09: DISPOSITIVOS DE LGICA PROGRAMABLE
Dispositivos lgicos programables. Dispositivos lgicos programables de alto nivel de integracin.
Ambiente de desarrollo de la lgica programable. La lgica programable y los lenguajes de descripcin
de hardware.
SEMANA N 10: LENGUAJES DE PROGRAMACIN EN HARDWARE

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Unidades bsicas de diseo. Declaracin de entidad. Declaracin de arquitectura. Diseo lgico
combinacional mediante VHDL. Declaraciones concurrentes. Declaraciones secuenciales. Ejemplos.
SEMANA N 11: VHDL: ORGANIZACIN Y ARQUITECTURA
Unidades bsicas de diseo, Entidad, Declaracin de Entidad. Diseo de Entidades. Arquitectura
SEMANA N 12: DISEO LGICO COMBINACIONAL MEDIANTE VHDL
Metodologa de programacin de estructuras bsicas mediante declaraciones concurrentes y
secuenciales. Ejercicios.
SEMANA N 13: DISEO LGICO SECUENCIAL MEDIANTE VHDL
Diseo Lgico Secuencial, Flip Flor Registros, contadores y Maquinas de Estados. Ejercicios.
SEMANA N 14: PRACTICA CALIFICADA
SEMANA N 15: DISEO DE APLICACIONES EN VHDL
Esquemas internos de la ALU. Bloque AND/OR. Bloque suma resta. Bloque multiplexor. Compilacin del
programa. Sntesis en FPGA.
SEMANA N 16 EXAMEN FINAL
SEMANA N 17 EXAMEN SUSTITUTORIO
7.

CALENDARIZACIN DE LOS LABORATORIOS

SEMANA N01: introduccin a los laboratorios, formacin de grupos de trabajo.
SEMANA N 02: sistemas secuenciales
SEMANA N 03: estructura y funcionamiento de las maquinas de estados
SEMANA N 04: diseo de sistemas secuenciales con maquina de estados Mealy
SEMANA N 05: diseo de sistemas secuenciales con maquina de estados Moore
SEMANA N 06: memorias semiconductoras
SEMANA N 07: discos magnticos
SEMANA N 08: examen parcial del curso (con suspensin de laboratorios)
SEMANA N 09: dispositivos de lgica programable
SEMANA N 10: lenguajes de programacin en hardware
SEMANA N 11: vhdl: organizacin y arquitectura
SEMANA N 12: diseo lgico combinacional mediante vhdl

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SEMANA N 13: diseo lgico secuencial mediante vhdl
SEMANA N 14: entrega de notas promedio de laboratorio a los alumnos
SEMANA N 15: entrega de notas de laboratorio a la Direccin de Escuela
8.

BIBLIOGRAFA
[1] Sistemas Digitales: Thomas Floyd.
[2] Diseo Digital : Jhon Wakerly
[3] Sistemas Digitales. Principios y Aplicaciones. Ronal J. Tocci. Ed. Prentice Hall
[4] VHDL: Lenguaje para sntesis y modelado de circuitos. Fernando Pardo y Jos A. Boluda. Alfaomega,
2000
[5] VHDL El Arte de programar sistemas digitales. David G. Maxinez y Jessica Alcal. CECSA, 1ra. Edicin,
Mxico 2002

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