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Sistemas Combinancionales
Sistemas Combinancionales
Introducci
on
Sistemas Combinacionales
Sistemas Secuenciales
RAE
Contenido
Introducci
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Sistemas Combinacionales
Sistemas Secuenciales
Introduccion
Sistemas Combinacionales
Sistemas Secuenciales
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Sistemas Combinacionales
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Condiciones superfluas
Las condiciones superfluas corresponden a aquellos casos en
que las combinaciones de variables de entrada no pueden
ocurrir.
Por ejemplo, si se quiere construir un circuito combinacional
para convertir n
umeros que estan en BCD (de 4 bits), a siete
salidas que representan los segmentos de un display.
RAE
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Sistemas Combinacionales
Sistemas Secuenciales
Condiciones superfluas
Nos enfocaremos en el segmento inferior derecho del display
(segmento c), cuya Tabla de Verdad corresponde a:
X3
0
0
0
0
0
0
0
0
X2
0
0
0
0
1
1
1
1
X1
0
0
1
1
0
0
1
1
X0
0
1
0
1
0
1
0
1
c
1
1
0
1
1
1
1
1
X3
1
1
1
1
1
1
1
1
RAE
X2
0
0
0
0
1
1
1
1
X1
0
0
1
1
0
0
1
1
X0
0
1
0
1
0
1
0
1
c
1
1
-
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Sistemas Secuenciales
Condiciones superfluas
RAE
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Condiciones superfluas
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Condiciones superfluas
Resultando la ecuaci
on:
F (X3 , X2 , X1 , X0 ) = X1 + X0 + X2
RAE
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AD +B AC
(A D) (B A C )
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(A + D) (B + A + C ) C
(A + D) + (B + A + C ) + C
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Sistemas Combinacionales
Utilizando compuertas NOR
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Sistemas Combinacionales
Hasta el momento solo hemos visto chips con compuertas
logicas elementales, con las cuales es posible representar
ecuaciones de conmutaci
on.
A medida que aumenta la cantidad de compuertas, nos vemos
en la necesidad de construir dispositivos l
ogicos altamente
integrados (VLSI).
Los dispositivos VLSI consideran una disminucion en el
tama
no (fsico) final de la soluci
on, en el costo por densidad
de compuertas y en la latencia del circuito combinacional
(debido a que las interconexiones internas son mas rapidas) .
Sin embargo es necesario construir un chip distinto, seg
un sea
la aplicacion, por lo que los costos en dise
no son bastante
altos.
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Flip-Flop
Estos elementos de memoria son representados mediante unos
dispositivos llamados Flip-Flop.
Los FLIP-FLOP (FF) estan constituidos por una combinacion
de compuertas digitales. Estas compuertas estan conectadas
de tal manera que es posible almacenar informacion.
Estas compuertas estan realimentadas y deben lograr cierta
estabilidad para poder almacenar informaci
on.
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Flip-Flop S-R
Este dispositivo es llamado Flip-Flop S-R.
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Flip-Flop S-R
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Flip-Flop S-R
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Sincronizacion
Existen sistemas digitales que operan de forma asncrona o
bien sncrona.
En los sistemas asncronos, los circuitos l
ogicos pueden
cambiar de estado en cualquier momento en que varen una o
mas entradas.
Los sistemas asncronos son difcil de dise
nar, y la tarea de
detectar fallas, es mas difcil a
un.
Por otra parte, en los sistemas sncronos los tiempos de las
salidas son discretos y estan dados por una se
nal de entrada
denominada reloj (CLK).
El CLK corresponde a una se
nal cuadrada, que se distribuye
en gran parte del sistema, permitiendo sincronizar las
transiciones de este.
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Flip-Flop Sincronizado
Para sincronizar un Flip-Flop, se puede incluir la se
nal CLK
como se muestra en la figura:
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Flip-Flop Sincronizado
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Flip-Flop Sincronizado
El instante en que la se
nal CLK cambia de 0 a 1, se denomina
canto de subida, y cuando cambia de 1 a 0 se llama canto de
bajada. El sincronismo del sistema puede estar dado por una
de estas dos transiciones.
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Flip-Flop Sincronizado
Para lograr sincronizar un Flip-Flop mediante cantos, se utiliza
un esquema Maestro-Esclavo, en el que se propagan las
entradas con la se
nal CLK.
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Flip-Flop
Existen distintos tipos de Flip-Flop, sin embargo todos
cuentan con una entrada CLK para su sincronizacion, ademas
de una salida (Q) y su complemento (Q).
Los Flip-Flop varan en el n
umero de entradas, y en las
transiciones que estas provocan.
Tpicamente un Flip-Flop se representan mediante la siguiente
figura:
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Flip-Flop S-R
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caracterstica
R Q n+1
0
Qn
1
0
0
1
???
1
Tabla de excitacion
Q n Q n+1 S R
0
0
0 0
1
1 0
1
0
0 1
- 0
1
1
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Flip-Flop D
Tabla caracterstica
D Q n+1
0
0
1
1
RAE
Tabla de excitacion
Q n Q n+1 D
0
0
0
0
1
1
1
0
0
1
1
1
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Flip-Flop J-K
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caracterstica
K Q n+1
Qn
0
1
0
0
1
1
Qn
Tabla de excitacion
Q n Q n+1 J K
0
0
0 0
1
1 1
0
- 1
- 0
1
1
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Flip-Flop T
Tabla caracterstica
T Q n+1
Qn
0
1
Qn
RAE
Tabla de excitacion
Q n Q n+1 T
0
0
0
0
1
1
1
0
1
0
1
1
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Diagramas de Estado
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Diagramas de Estado
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Primer Paso: Ecuaciones L
ogicas
Luego se expresan las ecuaciones de las entradas para cada uno de
los Flip-Flop.
JA = 1
KA = C B
JB = C
KB = A
RAE
JC = 1
KC = A + B
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Segundo Paso: Pr
oximos Estados
Utilizando la tabla caracterstica (en este caso la del los Flip-Flop
J-K ), se construyen los MK para los siguientes estados.
Tabla caracterstica
J
0
0
1
1
K
0
1
0
1
Q n+1
Qn
0
1
Qn
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Tercer Paso: Diagrama de Estados
Finalmente se dibuja el diagrama de estados, siguiendo las
transiciones de los Flip-Flop.
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Otro ejemplo de sistema secuencial
Se desea dise
nar un contador de 2 bits, que alterne desde 0 a 3.
El Primer Paso consiste en considera el siguiente diagrama
de estados donde X y Y son las salidas esperadas:
Qn
q1
q2
q3
q1
RAE
Q n+1
q2
q3
q4
q2
X
0
0
1
1
Y
0
1
0
1
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Segundo Paso: Asignaci
on Secundaria
Se deben asignar strings binarios (distintos) a cada estado. El
n
umero mnimo de bits necesarios para representar N estados
es log2 N, por lo que para 4 estados se requieren 2 bits.
Como los Flip-Flop son los encargados de almacenar los bits,
para este caso se requieren 2 Flip-Flop.
Luego la tabla
Q n Q n+1
00
01
01
10
10
11
11
00
resultante es:
X Y
0 0
0 1
1 0
1 1
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Tercer Paso: Elecci
on de Flip-Flop y Construcci
on de MK
Se debe elegir que tipo de Flip-Flop se utilizaran para
construir este circuito secuencial.
Si se utilizan Flip-Flop tipo D, los MK quedan de la siguiente
manera:
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Cuarto Paso: Construcci
on del circuito
Una vez que ya se obtuvieron las ecuaciones, mediante los
MK, se puede construir el circuito secuencial.
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Fin...
Fin...
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