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El flip-flop de tipo set/reset, se activa (set) a un estado de alto en el lado Q, por medio
de una seal de "set", y se mantiene en ese valor, hasta que se desactiva a una seal
baja, por medio de una entrada en el lado de reset. Esto se puede implementar como
el latch de puerta NAND o el latch de puerta NOR, y tambien como versin con pulso
de clock (sincronizado).
Una desventaja del flip-flop S/R, es que las entradas S=R=0 da un resultado ambiguo
y debe evitarse. El flip-flop J-K consigue superar este problema.
Flip-Flop J-K
El "flip-flop" tipo D, sigue a la entrada, haciendo transiciones que coinciden con las de
la entrada. El trmino "D", significa dato; este "flip-flop" almacena el valor que est en
la lnea de datos. Se puede considerar como una celda bsica de memoria. Un "flipflop" D, se puede hacer con un "flip-flop" "set/reset", uniendo la salida set (estado alto)
con la salida reset (estado bajo), a travs de un inversor. El resultado se puede
sincronizar.
El Flip-Flop T